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基于CPLD的单片多功能数字钟.pdf

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基于CPLD的单片多功能数字钟.pdf

机电工程技术年第卷第期机电工程技术年第卷第期基于’的单片多功能数字钟刘旄光,李玲(国防科技大学炮兵学院,湖南长沙)摘要本文介绍了一种基于’的单片多功能数字钟电路。文中阐述了采用原理图与,语言相结合设计电路的方法。关键词’;,;数字钟中图分类号/0文献标识码1文章编号02003422收稿日期/5引言近年来,可编程逻辑器件的广泛使用引发了电子产品领域的一场新的革命。可编程逻辑器件具有设计灵活、速度快、更改方便、功耗低等优点,在数字信号处理中得到广泛应用。采用可编程逻辑器件进行数字信号处理有许多优点,最明显的是系统的元件使用数目大大减少,可节约昂贵的’6板面积,而且具有功耗低、高速高可靠性等优点,其最大优点是设计的灵活性,另一方面还可以使用设计工具,帮助进行自动设计。芯片介绍设计时采用78987公司的05;5作为主芯片,该芯片具有以下特点()高性能。在所有可编程引脚之间828延时仅/。()容量较大。该芯片有5个宏单元,可用系统门为个。()系统可在直流电源进行编程,可以编程次。()该芯片为5脚;封装,体积较小。()ABC口的最高驱动电流为D1,可直接驱动E等。系统设计()结构原理该输出数字中具有整点报时、闹时、校时等功能,其顶层结构原理框图如图所示。()设计方法本设计用78987公司的E1软件FGHIJ8F,采用原理图与,语言相结合的方法。该软件在原理图设计中提供了丰富的集成模块以及基本模块,其中有/系列的大部分集成块以及各种加法器,基本模块有各种门、触发器等。用,语言来设计某些复杂模块,具有设计简洁、快速、稳定性高等优点。在此数字钟的设计中用,语言来设计译码器。()具体实现具体设计时,将’内部分为几个相对独立的功能模块,分别进行设计。采用/25十进制计数器来设计、5进制计数器,其电路如图所示。5进制计数器设计同上,只需将与非门1的输入端接计数器十位上的;’、;6即可。在设计电路时,可使用软件进行模拟。图就是模拟进制计数器的窗口。因为七段码译码器内部电路复杂,因而采用,语言设计,其源程序为98KLILMAEEENGOAEEEJHP9FQ8RP5I99N图顶层结构原理框图研究与开发机电工程技术年第卷第期机电工程技术年第卷第期图、’进制计数器电路图,/0123456789;AB6AC4D2E2FG6;82H9;AB6AC4’D2E2FFGD/GI3JKJH3/I3JK2L/0M

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