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基于单片机和FPGA的位同步信号提取.doc

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基于单片机和FPGA的位同步信号提取.doc

XXX学院毕业设计论文题目基于单片机和FPGA的位同步信号提取专业班级XX学生姓名X学号XX完成日期2X年6月指导教师XX实验师评阅教师20XX年6月2XXX学院应用技术学院毕业设计论文诚信承诺书本人慎重承诺和声明所撰写的基于单片机和FPGA的位同步信号提取是在指导老师的指导下自主完成,文中所有引文或引用数据、图表均已注解说明来源,本人愿意为由此引起的后果承担责任。设计论文的研究成果归属学校所有。学生签名年月日XXX学院应用技术学院毕业设计(论文)任务书设计(论文)题目基于单片机和FPGA的位同步信号提取姓名X专业X班级X学号16指导老师X职称实验师教研室主任X一、基本任务及要求本课题是设计一具有通用性的输入信号的位同步提取系统,系统可以实现10HZ1MHZ的信号同步。使用单片机进行实时控制现场可编程逻辑门阵列FPGA完成位同步信号提取,通过理论和实验研究,完成硬件电路和软件设计并试制样机,要求完成1、单片机实时控制FPGA,完成实时频率跟踪测量和自动锁相;2、在FPGA内部,设计完成以下部分A、全数字锁相环DPLL,主要包含数控振荡器、鉴相器、可控模分频器B、LED动态扫描电路、FPGA和单片机的数字接口,以完成两者之间的数字传递3、设计辅助电路键盘、LED;二、进度安排及完成时间(1)第二周至第四周查阅资料、撰写文献综述和开题报告;(2)第五周至第六周毕业实习;(3)第六周至第七周项目设计的总体框架各个模块以及各个模块之间的关系确定,各个模块的方案选择与各个模块的所用主要器件的确定;(4)第八周至第十三周各个模块的主要器件熟悉及相关知识的熟悉;各个模块的具体任务实现硬件电路、软件编程;(5)第十四周至第十五周系统的总体仿真与调试(6)第十六周至第十七周撰写设计说明书;(7)第十八周毕业设计答辩;基于单片机和FPGA的位同步信号提取目录摘要错误未定义书签。ABSTRACT错误未定义书签。引言错误未定义书签。第1章绪论错误未定义书签。11位同步技术当前的发展错误未定义书签。12EDA简介3138051型单片机错误未定义书签。14FPGA器件简介错误未定义书签。141FPGA器件的发展错误未定义书签。142FPGA器件的结构错误未定义书签。143ALTERA器件及EPM7064错误未定义书签。15FPGA开发过程简介错误未定义书签。16C语言错误未定义书签。17VER

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