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文档简介

学院：电气信息学院 专业： 电子信息工程 班级：一班 姓名学号实验序号1实验时间2012-10-10指导教师成绩实验项目名称2选1多路选择器实验目的熟悉Quartus II 6.0的VHDL文本设计流程全过程，学习简单组合电路的设计、多层次电路设计、仿真和硬件测试。实验内容实验内容1：首先按照4.4 节给出的步骤，利用MAX+plus II 完成2 选1 多路选择器的文本编辑输入（mux21a.vhd）和仿真测试等步骤，给出图4-27 所示的仿真波形。最后在实验系统上进行硬件测试，实际验证本项设计的功能。实验内容2：将4.4 节的多路选择器看成是一个元件mux21a，利用元件例化语句描述图4-38，并将此文件放在同一目录E:muxfile 中。以下是部分参考程序：.COMPONENT MUX21APORT （ a，b，s : IN STD_LOGIC;y : OUT STD_LOGIC）;END COMPONENT ；.u1 : MUX21A PORT MAP（a=a2，b=a3，s=s0，y=tmp）;u2 : MUX21A PORT MAP（a=a1，b=tmp，s=s1，y=outy）;END ARCHITECTURE BHV ;按照4.4 节的步骤对上例分别进行编译、综合、仿真。并对其仿真波形作出分析说明。实验内容3：引脚锁定以及硬件下载测试。若目标器件是EF1K30，建议选实验电路模式5（，用键1）控制s0；用键2控制s1；a3、a2和a1 分别接clock5、clock0和clock2；输出信号outy仍接扬声器spker。通过短路帽选择clock0 接256Hz 信号，clock5 接1024Hz，clock2 接8Hz 信号。最后进行编译、下载和硬件测试实验。程序：实验编程及运行结果ENTITY MUX21A ISPORT (A,B,S: IN BIT;Y: OUT BIT );END ENTITY MUX21A;ARCHITECTURE ONE OF MUX21A ISBEGINPROCESS (A,B,S)BEGINIF S=0 THENY= A; ELSEY=B;END IF;END PROCESS;END ARCHITECTURE ONE ;引脚编辑：仿真框图：逻辑框图：实验总结在使用中我熟悉Quartus II 6.0的VHDL文本设计流程全过程，学习了简单组合电路的设计、多层次电路设计、体验了仿真和硬件测试的全过程。课 题： EDA技术实用教程 专 业： 电子信息工程班 级： 一 班学 号： 20100178
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