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文档简介

1、 S0 S1 操作 说明 0 0 无 处于0串中，不需要操作 0 1 加x 1串的结尾 1 0 减x 1串的开始 1 1 无 处于1串中，不需要操作 输入信号XCV200芯片引脚 乘数末尾八位输入端S0 K0103 K1102 K2101 K3100 K4097 K5096 K6095 K7094乘数末尾八位输入端S1 K0087 K1086 K2085 K3084 K4082 K5081 K6080 K7079 输入信号输出信号S0S1qCC58DC021836018585818505XCV200芯片引脚信号XCV200实验板S0 K1S1K2q LED1输 入 信 号输 出 信 号K1 K

2、2LED1CC58DC课程设计总结：本次实验有接触到了新的硬件语言VERILOG，语言并不是做电路的关键，最重要是对基本器件的灵活运用，和逻辑框图的生成，这些是我们应该具备的基本的能力，从而一步一步完成电路的搭建。经过一学期课堂上理论的学习，对计算机的硬件结构有了初步的了解，对计算机并不一定有深刻的理解，通过做实验能学到书本上面没的东西，有增强了自己的动手能力。我的课设题目为定点补码一位乘法器的设计，该设计逻辑电路主要是通过一个三选一数据选择器对两个输入端的不同输入作出输出选择，即S0，S1为两输入端，若结果为01，则部分积加X补；若结果为00或者11，则部分积加0；若结果为10，则部分积加-X补。通过选择器的选择功能和加法器达到补码一位乘法器的工作效用。尽管在实验过程中遇到过很多的问题，但是正是因为这些问题，才能更好的完善自己的知识体系，使自己更加进步。感谢本次课程设计

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