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文档简介

1、两个独立的功能部件:执行部件EU、总线接口部件BIU。,22 80X86微处理器的编程结构,22 80X86微处理器的编程结构,221 基本结构寄存器 通用数据寄存器,22 80X86微处理器的编程结构,22 80X86微处理器的编程结构,标志寄存器EFLAGS (Flags) CPU的控制标志和运算结果状态标志。,80486 :D0D18的15个标志 PENTIUM :D0D21的18个标志。,标志寄存器EFLAGS (Flags) 8086的状态标志和控制标志:,TF,DF,IF,OF,SF,ZF,AF,PF,CF,控制标志,状态标志,跟踪,状态标志:标示CPU运行结果的状态。结果为零、为

2、负、产生进位或借位等。 控制标志:控制CPU的运行状态。,221 基本结构寄存器,22 80X86微处理器的编程结构,段寄存器 对所有X86级CPU均为16位寄存器。 8086CPU: 段寄存器直接给出段基址。 代码段:CS 代码段存贮区的起始地址 堆栈段:SS 堆栈段存贮区的起始地址 数据段:DS、ES、FS、GS (8086只有二个数据段寄存器DS、ES) 数据段存贮区的起始地址,221 基本结构寄存器,22 80X86微处理器的编程结构,80286以上CPU: 由段寄存器(选择器)经全局描述符或局部描述符寄存器得到相应的描述符表,从而得到段基址,与偏移地址相加得到线性物理地址。,控制寄存

3、器 实现对处理器的多种功能控制与选择。P29P32表25、表26、表27分别给出了一些位的定义。,22 80X86微处理器的编程结构,222系统级寄存器,系统段寄存器 LDTR局部描述子表寄存器为16位寄存器。 TR能在任务或进程之间切换,是多用户操作系统一个重要属性。,5个控制寄存器CR0CR4、2个系统地址寄存器GDTR、IDTR、2个系统段寄存器TR、LDTR组成。,系统地址寄存器 GDTR全局描述表寄存器为48位,存放全局描述子表的段基址。 IDTR中断描述子表寄存器为48位,存放中断描述子表的段基址。,223调试和测试寄存器 224浮点寄存器,存贮器的逻辑地址 将1MB空间,小于等于

4、216=64K连续的存储器为一段,分为多个段。每个段可以独立寻址。 段地址:段内偏移地址的表示方法称逻辑地址。 如,2000H:100H,补充: 8086存储器的分段管理,8086同时可有4个段被激活(称当前段)。它们是CS代码段、DS数据段、SS堆栈段、ES附加数据段。 分段之间必须: 1保持16个字节或其整数倍为段地址间距。 216位段寄存器表示段基址。段寄存器加1实际上存储器地址加16。 3段可连续、分散、重迭。 物理地址PA=段地址16+偏移地址(EA),段地址:段的起始地址,(段的编号)是该段的最低地址。 偏移地址:段内地址的顺序编号。,225 8086存储器的分段管理,可以表为01

5、00H:0023H PA=0100H10H+0023H =1023H,225 8086存储器的分段管理,也可表为0102H:0003H PA=0102H10H+0003H =1023H,两段间距为20H单元,两种逻辑地址表示同一个物理地址单元01023H。,例:对于物理地址1023H单元,指令译码,执行指令ADD AL,100H,CS:IP=F0300H IP指下条指令,ADD指令,指令队列,CPU引脚生成系统总线:ABUS、DBUS、CBUS联接 ROM、RAM、I/O接口形成微型计算机。,23 80X86微处理器的引脚功能,2、控制总线,23 80X86微处理器的引脚功能,(4),(10)GND、VCC VCC=+5V,GND=0V 电源的正负极。,最小工作模式下的控制信号。,(14),可数据允许 ,单向,输出。,最大工作模式下的控制信号。,(1)QS0、QS1,指令队列状态,单向、输出。,最大工作

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