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文档简介

实验名称：四选一多路选择器 一、实验目的及要求 通过本次实验进一步掌握 Modelsim SE 6.5c的仿真调试方法及过程思想，并且进一步学习理解语言门级结构建模的原理及方法，通过仿真达到学习知识的目的。通过反复阅读有关资料，能够熟练掌握四选一多路选择器的程序代码设计及其仿真结果分析。二、实验程序及仿真结果四选一的verilog代码module mux4_1(out,in0,in1,in2,in3,sel);output out;input in0,in1,in2,in3;input1:0 sel;reg out;always (in0 or in1 or in2 or in3 or sel) begincase(sel)2b00: out=in0;2b01: out=in1;2b10: out=in2;2b11: out=in3;default: out=2bx;endcaseendendmodule相应测测试代码：timescale 1ns/100psmodule tmux; reg 1:0sel; reg in0,in1,in2,in3; wire out; mux4_1 mux(out,in0,in1,in2,in3,sel);initialbegin in0 = 1;in1 = 0;in2 = 1;in3 = 0; sel = 00; #30 sel = 10; #30 sel = 11; #30 sel = 01;endendmodule3、 实验小结通过这次四选一多路选择器的实验仿真，让我
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