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文档简介
1. 数制转换(P1)2. ASCII码 (P9)字符ASCII码(H)0 930 39A Z41 5Aa z61 7A换行LF0A回车CR0D3. BCD码 (P10)二进制编码的十进制数十进制数压缩BCD数非压缩BCD数(ASC II BCD 数)00H(0000B)00H(0000 0000B)11H(0001B)01H(0000 0001B)22H(0010B)02H(0000 0010B)33H(0011B)03H(0000 0011B)44H(0100B)04H(0000 0100B)55H(0101B)05H(0000 0101B)66H(0110B)06H(0000 0110B)77H(0111B)07H(0000 0111B)88H(1000B)08H(0000 1000B)99H(1001B)09H(0000 1001B)4. 解释图1-9 存储原理 写出旁边的表 (P14) 5. 全加器真值表 和、进位逻辑代数式 画出电路图 什么时候做加法 什么时候做减法(PPT)6. 8086/8088寄存器名称及用途(P24-25) 7. 8086/8088物理地址的生成(P28-29)由于8086/8088有20条地址线,可以寻址多达1M字节,所以把1M字节的存储器分成任意数量的段,其中每一段最多可以寻址64K字节。这样每一个段就必须开始于一个能被16整出的地址。段地址和偏移地址一样都是16位无符号二进制整数,其值可为0000HFFFFH,故可以将存储器分为64K个段。8086/8088中有一个地址加法器,它将寄存器提供的段地址自动乘以10H即左移4位,然后与16位的偏移地址想家,并锁存在物理地址锁存器中,每次需要生成物理地址的时候,一个段寄存器会自动被选择,且能自动左移4位,再与一个16位的偏移地址相加,产生所需要的20位物理地址。8. 习题1.5、1.7(P32)9. 例3.29(P137)方法一:ABCDCB PROC MOV AX,0 ABCDC1: PUSH CX MOV CX,10 ; Xi x 10 + Xi - 1 MUL CX AND BYTE PTRSI,0FH ADD AL,SI ADC AH,0 INC SI POP CX LOOP ABCDC1 RET ABCDCB ENDP方法二:SUBCODE SEGMENT ASSUME CS: SUBCODE ABCDCB PROC FAR MOV AX,0 ABCDC1: PUSH CX MOV CX,10 MUL CX AND BYTE PTRSI,0FH ADD AL,SI ADC AH,0 INC SI POP CX LOOP ABCDC1 RET ABCDCB ENDP SUBCODE ENDS 10. 例3.30(P139) BCABCD PROC PUSH AX PUSH BX PUSH CX PUSH DX PUSH DI OR AX, AX JNS PLUS MOV BYTE PTR EX: DI, - INC DI NEG AX PLUS: MOV CX,0 MOV BX, 10 LOP1: MOV DX, 0 DIV BX PUSH DX INC CX OR AX, AX JNZ LOP1 LOP2: POP AX ADD AL, 30H MOV ES:DI, AL INC DI LOOP LOP2 MOV AL, $ MOV ES:DI, AL POP DI POP DX POP CX POP BX POP AX RET BCABCD ENDP11. 总线概述(P164)总线是一种数据通道,由系统中各部件所共享,或者说,是在部件与部件之间传送信息的一组公用信号线,是将发送部件发出的信息准确地传送给某个接收部件的信号通路。12. 图4-1 (P165)解释此图 分清三组总线 地址 数据 控制 两个组态13. 中断响应信号(P166)INTA:中断响应信号。此信号低电平有效,是8088响应中断请求信号引线INTR来的外部中断时输出的中断响应信号,它可以用做中断向量类型码的读选通信号。14. 中断请求信号、非屏蔽中断请求信号(P168)INTR:中断请求信号。此信号高电平有效,是外设发来的可屏蔽中断请求信号。CPU在每一条指令结束前均要采样该引线,以决定是否中断现行程序的执行,进入中断服务程序。该信号可以用标志寄存器中的中断允许标志位来屏蔽。NMI:非屏蔽中断请求信号。该信号是一个边沿触发信号。这条线上的中断请求信号是不能屏蔽的,只要这条线上有由低到高的变化,就在现行指令结束之后中断现行程序的执行,进入非屏蔽中断服务程序。15. 图4-8(P173)8284是时钟发生器 8259是中断控制器 使CPU线分出8根 地址总线那块是把地址锁存X分离 数据那块作用是把数据锁存 8288是控制总线,XX 8088的控制信号16. 图4-10(P175)它与存储器读周期类似,首先也要有IO/M信号来表示进行存储器操作。其次也要有写入单元的地址,以及ALE信号。不同的是要写入存储器的数据,在T2状态,也即当12位数据线A19A16,A7A0已有ALE锁存后,CPU就把要写入的8位数据放至AD7AD0上。要写入,当然要由信号WR来代替RD信号,它也在T2状态有效。因为要实现写入,故DT/R信号应为高电平17. ISA总线(P182)ISA总线: (Industry Standard Architecture:工业标准体系结构)是IBM公司为PC/AT电脑而制定的总线标准,为16位体系结构,只能支持16位的I/O设备,数据传输率大约是16MB/S。也称为AT标准。开始时PC机面向个人及办公室,定义了8位的ISA总线结构,对外公开,成为标准(ISO ISA标准)。第三方开发出许多ISA扩充板卡,推动了PC机的发展。1984年推出IBM-PC/AT系统,ISA从8位扩充到16位,地址线从20条扩充到24条。1988年,康柏、HP、NEC等9个厂商协同把ISA扩展到32位,即EISA总线(Extended ISA)。18. PCI局部总线(P183)PCI局部总线是INTEL公司为适应奔腾高性能而开发的32/64位总线,它的总线时钟频率为系统主板时钟频率的1/2,是ISA总线的4倍。独立于处理器,除了高速传输特性,还实现了外部设备自动配置功能,19. 分级存储体系(P194)目前采用较多的是3级存储器结构,即高速缓冲存储器、内存储器和辅助存储器。中央处理器CPU能直接访问的存储器有Cache和内存。CUP不能直接访问辅存,辅存中的信息必须先调入内存才能由CPU处理。形成这种分级体系也无可奈何,但不造成这样,CPU的高速与后续储存的高容量便会受到限制,这样只是为了把限制减少。20. 六管静态MOS记忆电路 读写过程(PPT)21. ROM与RAM区别(P198)ROM和RAM是计算机内存储器的两种型号,ROM表示的是只读存储器,即:它只能读出信息,不能写入信息,计算机关闭电源后其内的信息仍旧保存,一般用它存储固定的系统软件和字库等。RAM表示的是读写存储器,可其中的任一存储单元进行读或写操作,计算机关闭电源后其内的信息将不在保存,再次开机需要重新装入,通常用来存放操作系统,各种正在运行的软件、输入和输出数据、中间结果及与外存交换信息等,我们常说的内存主要是指RAM。22. 给ROM图判断每个位置存的二进制信息我想二极管跟MOS应该原理一样吧,即二极管存1,没有的地方存023. SRAM与DRAM概念(P198)DRAM-动态随即存取器,需要不断的刷新,才能保存数据,而且是行列地址复用的,许多都有页模式SRAM-静态的随机存储器,加电情况下,不需要刷新,数据不会丢失,而且一般不是行列地址复用的24. 习题5.3(P206)25. 接口的一般定义(P207)接口是一组电路,是中央处理器与存储器、输入/输出设备等外设之间协调动作的控制电路。26. 并行数据传送、串行数据传送、异步串行通信协议(P208)并行数据传送。在微型计算机系统内,如大系统部件之间的数据传送都采用并行数据传送方式。并行数据的每一位都对应独立的传输线路,所以数据传输速度快,但线路较多,一般只用于较短距离的数据传送。串行数据传送。串行数据传送是将构成字符的每个二进制数据位,按一定的顺序逐位进行传送的方式。异步串行通信协议规定字符数据的传送格式,每个数据以相同的位串形式传送,但数据间隔脉冲不定。27. 两种I/O接口结构(P211)通常有两种I/O接口结构:一种是标准I/O结构,另一种是存储器映象I/O结构,与之对应有两种I/O寻址方式。28. 看图6-11写发光表代码(P217)SEGPT DB 40H, 79H, 24H, 30H, 19H, 12H, 2 ,78H, 0, 18H29. 模/数转换(P227)模/数转换就是把输入的模拟量变为数字量,供微型计算机处理。数/模转换就是将微型计算机处理后的数字量转换为模拟量输出。30. 中断(P241)所谓中断,是指计算机在正常运行的过程中,由于种种原因,使CPU暂时停止当前程序的执行,而转去处理临时发生的事件,处理完毕后,再返回去继续执行暂停的程序。31. 中断的条件 中断IF(不肯定,没听清)32. 向量中断(P245)在具有向量中断的微型计算机系统中,每个I/O设备都预先指定一个中断向量。当CPU识别出某个I/O设备的中断向量送入CPU,CPU根据中断向量得到相应的中断服务程序的入口地址,转入中断服务。33. 8259A(P246)INTEL 8259A是8080/8085序列以及80x86序列兼容的可编程的中断控制器。34. 级联,貌似1级8个 2级有64个(P248)35. 外部中断(P251)(其实就是前面有一个相同的概念)80x86微处理器芯片均有两条外部中断请求线:NMI和INTR36. 习题7.1、7.437. 程序题M
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