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文档简介

实验五 计数器的设计一 实验内容：1.用JK触发器设计一个16进制异步计数器，用逻辑分析仪观察CP和各输出的波形。实验设计：通过卡诺图化简易得电路图：波形图：2. 用JK触发器设计一个16进制同步计数器，用逻辑分析仪观察CP和各输出的波形。实验设计：通过卡诺图化简易得电路图：波形图：3.用JK触发器和门电路设计一个具有置零，保持，左移，右移，并行送数功能的四位二进制计数器模仿74LS94功能。列出真值表，通过卡诺图化简可得电路图：4.用JK触发器和门电路设计一个特殊的12进制同步计数器，其十进制的状态转换图为01-02-03-04-05-06-07-08-09-10-11-12-01正向：通过卡诺图化简可知：J0 = 1 J1 = Q0 J2 = Q1Q0 J3 = Q2Q1Q0K0 = 1 K1 = Q0 K2 = Q3 + Q1Q0 K3 = Q2可得电路图：波形图：反向：通过卡诺图化简可知：J0 = 1 J1 = Q0Q1 J2 = Q1Q0 + Q3Q1 J3 = Q2Q1K0 = 1 K1 = Q0 K2 = Q1Q0 K3 = Q2Q1Q0可得电路图：波形图：5.增加一个控制变量D，当D=0时，计数器增序运行，当D=1时，计数器减序运行。实现这个计数器，只需要在每个触发器的J，K端口添加或门进行输入信号的选择由内容4可得电路图：波形图：当开关往上拨的时候如图：当开关往下拨 波形如图：二 实验结果：1. 16进制异步计数器2. 16进制
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