基于FPGA的点阵显示器课程设计报告(共18页)

1、精选优质文档-倾情为你奉上 JIANGSU TEACHERS UNIVERSITY OF TECHNOLOGY 数字电路课程设计报告基于FPGA的8*8点阵显示器 学院名称： 电 信 学 院 专 业： 电气工程及其自动化专业 班 级： 08电气2 姓 名： 韩 韬 同组姓名： 董 立 峰 学 号： 指导教师姓名： 宋伟 黄成 2010 年 12 月 一 课题要求（1）技术要求掌握较复杂逻辑的设计，调试。掌握用VHDL语言设计数字逻辑电路。掌握quartusII6.0软件的使用方法。了解8*8列共阴点阵显示器的工作原理和功能。掌握常用驱动电路的原理及使用方法。掌握EP2C5T144C8芯片的使用

2、。（2）功能要求本设计为基于FPGA的8*8点阵显示器，运用VHDL语言编写软件，并通过硬件来实现显示汉字，及滚动，屏显等功能。主要功能：静态显示一个完整的汉字能一屏一屏动态显示多个汉字能滚动动态显示多个汉字能通过开关控制点阵显示方式（3）本人工作在此次课程设计中我主要负责软件的编写与仿真。以及软件的下载。二 设计方案1 原理图要实现8*8点阵显示器显示动态汉字的功能，主要实现两方面的设计：硬件部分和软件部分。2 硬件部分硬件部分主要包括：驱动电路，点阵显示器，端口降压电路。本次使用的点阵显示器为列共阴型点阵显示器。及当行为高电平，列为低电平是对应的发光二极管反光。硬件部分的主要功能是将软件中

3、输出的行列信号在点阵中显示出来。3 软件部分软件部分通过调用汉字库的方式来实现汉字的显示。通过逐列扫描的方法来实现完整的汉字显示。编辑输入：首先根据课程设计与硬件要求在quartus中编写软件。功能仿真与时仿真：利用EDA工具软件对EDA设计进行模拟，验证设计和排除错误。锁定端口：结合硬件要求锁定各个端口。编程下载：把生成的编程文件通过编程器载入目标器件，以便进行硬件验证和调试，进而完成设计。library ieee;use ieee.std_logic_1164.all;use ieee.std_logic_unsigned.all;use ieee.std_logic_arith.all;

4、 库说明部分entity dian isport(clk,k,k1:in std_logic; 定义时钟信号，滚动开关k和屏显开关k1 com:out std_logic_vector(7 downto 0); 行共阳输出控制端口 lie:out std_logic_vector(7 downto 0); 列共阴输出控制端口end dian;architecture one of dian issignal st:std_logic_vector(7 downto 0);signal osc:std_logic; 列扫描控制信号signal osd:std_logic; 字库地址控制信号sig

5、nal dff:std_logic_vector(24 downto 0);signal data:std_logic_vector(7 downto 0);signal d0,d1,d2,d3,d4,d5,d6,d7:std_logic_vector(7 downto 0);signal lie0:std_logic_vector(7 downto 0);begincom<=data;lie<=st;d0<=""when lie0=""else""when lie0=""else"&q

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40、n lie0=""else""when lie0=""else""when lie0=""else""when lie0=""else""when lie0=""else""when lie0=""else""when lie0=""else""when lie0=""else""

41、;when lie0=""else""when lie0=""else""when lie0=""else""when lie0=""else""when lie0=""else""when lie0=""else"" 字库7first:processbeginwait until clk='1'if dff>=2e7 thendff&

42、lt;="000"elsedff<=dff+1; dff进行加1循环osc<=not dff(8); 时钟信号osc为以信号dff第8位变化频率变化 osd<=not dff(24); 时钟信号osd为以信号dff第24位变化频率变化end if;end process first;second:process(osc)beginif osc'event and osc='1' thenif st(7 downto 0)="" or st(7 downto 0)=""thenst(7 down

43、to 0)<=""data<=d0;elsif st(7 downto 0)=""thenst(7 downto 0)<=""data<=d1;elsif st(7 downto 0)=""thenst(7 downto 0)<=""data<=d2;elsif st(7 downto 0)=""thenst(7 downto 0)<=""data<=d3;elsif st(7 downto 0)="

44、;"thenst(7 downto 0)<=""data<=d4;elsif st(7 downto 0)=""thenst(7 downto 0)<=""data<=d5;elsif st(7 downto 0)=""thenst(7 downto 0)<=""data<=d6;elsif st(7 downto 0)=""thenst(7 downto 0)<=""data<=d7;end if

45、;end if;end process second; 进行逐列扫描third:process(osd)beginif(osd='1' and osd'event) thenif k1='1' then k1为高电平是滚动case k iswhen '1' =>if lie0(7 downto 0)="" thenlie0(7 downto 0)<=""else lie0<=lie0+1;end if; k为1是向左滚动when '0' =>if lie0="" thenlie0<=""else lie0<=lie0-1;end if; k为0是向右滚动end case;elsif k1='0' then k1为低电平时为屏显 if lie0="" or lie0<=""then lie0<="" else lie0<=lie0+1; end if;end if;end if;