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文档简介
码器初始化配置完成后,接收CPU发送的译码指扩展接口AXI从总线存储器处读取目标译码数码后获得的译码结果存入译码器内置的输出寄2对所述编码多项式进行分析,并根据编码多项式的分析结果,结合所将译码后获得的译码结果存入所述译码器内置的输出3.根据权利要求2所述的方法,其特征在基于所述AXI向所述总线存储器发送译码4.根据权利要求3所述的方法,其特征在于,所述译码器内置的模块包括数据访问模所述度量计算控制模块,用于从所述译码数据存储器中获取待进行所述路径信息存储模块,用于存储解码过程中的路径信息,以所述路径回溯控制模块,用于根据所述路径信息存储模块中保存的34基于内置的高级可扩展接口AXI从总线存储器处读取目标译码数据,并对读取到的目标译[0011]度量计算控制模块,用于从译码数据存储器中获取待进并基于目标译码数据计算每个时刻各个状态到达当前状态的所有可能路5[0023]本申请上述的和/或附加的方面和优点从下面结合附图对实施例的描述中将变得[0024]图1是本申请一个实施例示出的一种译码器的译码方法的示例性实施方式的示意67是一种基于硬件加速的直接存储器访问技术,它可以实现CPU和存储器之间的高效数据传[0053]度量计算控制模块,用于从译码数据存储器中获取待进并基于目标译码数据计算每个时刻各个状态到达当前状态的所有可能路8据,同时也可以从总线存储器中读取目标译码数据。由于目标译码数据的存储地址连续,进行咬尾卷积码的译码。咬尾卷积码是指编码器输出序列末尾部分可能存在的错位现象,位置关系,仅是为了便于描述本申请和简化描述,而不是指示或暗示所指的装置或元件必术人员可以将本说明书中描述的不同实施例或示例以及
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