华中科技大学计算机学院数字电路与逻辑设计试卷A (闭卷)

A班级学号姓名成绩一．单项选择题（每题1分，共10分）1．表示任意两位无符号十进制数需要（）二进制数。A．6B．7C．8D．92．余3码10001000对应的2421码为（A．01010101B.10000101C.101110113．补码1．1000的真值是（A．+1.0111B.-1.01114．标准或-与式是由（）构成的逻辑表达式。D.11101011C.-0.1001D.-0.1000D.或项相与A．与项相或B.最小项相或ACCDEC.最大项相与5.根据反演规则，FE的反函数为（A.F[ACC(DE)]EB.FACC(DE)EC.F(ACCDE)ED.FCC(DE)E6．下列四种类型的逻辑门中，可以用（）实现三种基本运算。A.与门C.非门7．将D触发器改造成T触发器，图1所示电路中的虚线框内应是（B.或门D.与非门图1A.或非门B.与非门C.异或门D.同或门8．实现两个四位二进制数相乘的组合电路，应有（）个输出函数。A．8B.9C.10D.119．要使JK触发器在时钟作用下的次态与现态相反，JK端取值应为（A．JK=00B.JK=01C.JK=10D.JK=1110）个异或门。A．2B.3C.4D.5,,并在划线处改正。每题2分，共10分）1．原码和补码均可实现将减法运算转化为加法运算。（）2．逻辑函数F(A,B,C)M(1,3,4,6,7),则F(A,B,C)m(0,2,5)。（）3）4．并行加法器采用先行进位（并行进位）的目的是简化电路结构。（）5.图2所示是一个具有两条反馈回路的电平异步时序逻辑电路。()图2三．多项选择题(从各题的四个备选答案中选出两个或两个以上正确答案，并将其代号填写在题后的括号内，每题2分，共10分)1．小数“0”的反码形式有（A．0．0……0；C．0．1……1；B．1．0……0；D．1．1……12．逻辑函数F=A⊕B和G=A⊙B满足关系（D.则F和G相“与”的结果FGFG1A.FG3．若逻辑函数F(A,C)FGB.C.G(A,C)是（mmA．B．1C．D．ABAB234x和yzzA．x和y同为高电平；B．x为高电平，y为低电平；C．x为低电平，y为高电平；D．x和y同为低电平.5．组合逻辑电路的输出与输入的关系可用（）描述。B.流程表D.状态图A．真值表C．逻辑表达式四．函数化简题（10分）1．用代数法求函数F(A,B,C)ABACBCAB的最简“与-4分）2．用卡诺图化简逻辑函数F(A，B，C，D)＝∑m(2，3，9，11，12)+∑d(5，6，7，8，10，13)求出最简“与-或”表达式和最简“或-6分）3图315分）图3要求：1．填写表1所示真值表；表1ABCD00000001001000110100010101100111WXYZABCD100010011010101111001101111011112．利用图4所示卡诺图，求出输出函数最简与-或表达式；图43．画出用PLA实现给定功能的阵列逻辑图。4．若采用PROM实现给定功能,要求PROM的容量为多大？六、分析与设计（15分）某同步时序逻辑电路如图5所示。图5(1)写出该电路激励函数和输出函数；(2)填写表2所示次态真值表；表2输出Z输入现态激励函数XQQJKJK(3)填写表3所示电路状态表；表3输出X=0X=100011011（4）设各触发器的初态均为0，试画出图6中Q、Q和Z的输出波形。12图6（5）改用T触发器作为存储元件，填写图7中激励函数T、T卡诺图，求出最21简表达式。图7七．分析与设计（15分）某电平异步时序逻辑电路的结构框图如图8所示。图中：Yxyxyxxy11222221Yxyyxxxxy211121212Zxxy212要求：图81．根据给出的激励函数和输出函数表达式，填写表4所示流程表；表4YY/Z21xx=102211000111102.判断以下结论是否正确，并说明理由。①该电路中存在非临界竞争；②该电路中存在临界竞争；3．将所得流程表4中的00和01互换，填写出新的流程表5，试问新流程表对应的电路是否存在非临界竞争或临界竞争？表5YY/Z21xx=102100011110八．分析与设计（15分）某组合逻辑电路的芯片引脚图如图9所示。图91．分析图9所示电路，写出输出函数F、F的逻辑表达式，并说