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编解码器设计

是一种针对数字信号处理而特别设计的微处理器。基于DTMF的解码器设计。给出了在解码器中与89C51单片机的接口电路。基于FPGA的HDB3编解码器的设计。然后提出了一个基于FPGA的HDB3编码器和译码器的新的设计。然后提出了一个基于FPGA的HDB3编码器和译码器的新的设计。并介绍了硬件设计电路和软件仿真。

编解码器设计Tag内容描述：<p>1、基于FPGA的HDB3编解码器的设计摘要：本文简要介绍了HDB3的基本原理和结构，分析了现有的HDB3编码器和译码器的缺点，然后提出了一个基于FPGA的HDB3编码器和译码器的新的设计，并介绍了硬件设计电路和软件仿真。在Quartus7.2的开发环境中，通过VERILOG-HDL在EP2C35F672C8 CycloneII系列的芯片上来实现仿真。结果表明，本设计满足HDB3编码器和译码器的要求，具有简易的硬件电路和灵活可变的软件，运算快速，可以用在特定的通信系统。关键词：FPGA；HDB3；编码器和译码器I. 介绍通信链路的编码研究是现代数字通信技术的重要课题。行模式选择。</p><p>2、基于FPGA的HDB3编解码器的设计摘要：本文简要介绍了HDB3的基本原理和结构，分析了现有的HDB3编码器和译码器的缺点，然后提出了一个基于FPGA的HDB3编码器和译码器的新的设计，并介绍了硬件设计电路和软件仿真。在Quartus7.2的开发环境中，通过VERILOG-HDL在EP2C35F672C8 CycloneII系列的芯片上来实现仿真。结果表明，本设计满足HDB3编码器和译码器的要求，具有简易的硬件电路和灵活可变的软件，运算快速，可以用在特定的通信系统。关键词：FPGA；HDB3；编码器和译码器I. 介绍通信链路的编码研究是现代数字通信技术的重要课题。行模式选择。</p>

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毕业论文——基于FPGA的HDB3编解码器的设计!

上传时间: 2019-02-15 大小: 239.50KB 页数: 8

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