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I 设计题目设计题目。基于基于 CPLDCPLD 秒表计时器设计秒表计时器设计院院系系。一系一系专专业业。电子科学与技术电子科学与技术班班级级。基于FPGA/CPLD的数字电压采集。电子与信息工程学院。专业。

基于cpldTag内容描述：<p>1、I 设计题目设计题目: : 基于基于 CPLDCPLD 秒表计时器设计秒表计时器设计院院系系: : 一系一系专专业业: : 电子科学与技术电子科学与技术班班级级: : 0 0 3 3 0 0 6 6 姓姓名名: : 指导老师指导老师: : 华中科技大学武昌分校华中科技大学武昌分校 2006 年年 12 月月 18 日日 II 毕业设计毕业设计( (论文论文) )任务书任务书学生姓名学生姓名朱林志专业班级专业班级电子科学与技术系指导教师指导教师乐雄军工作单位工作单位武汉理工大学设计设计(论文论文)题目题目: 基于 CPLD 秒表计时器设计设计（论文）主要内容：。</p><p>2、2011 届毕业设计（论文）题目：基于FPGA/CPLD的数字电压采集学院：电子与信息工程学院专业：班级：姓名：指导教师：起讫时间：2011-3-12011-6-18二一一年六月35基于FPGA/CPLD的电压数据采集摘要基于FPGA/CPLD的数字电压表，它设计简单，且相对于用微处理器控制通用A/D转换期间的数字电压表的设计的灵活性明显提高，系统功能的扩展变得简单，在使用过程中得到了广泛的运用。因此，基于FPGA的数字电压表是一款具有一定研究价值和实用价值的产品。本次设计采用EDA技术和FPGA芯片设计数字电压表。在硬件方面，主要描述了ADC0809转换。</p>

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