verilog的基本语法
verilog2009--TJU. ASIC Center---Arnold Shi。0、低、伪、逻辑低、地、VSS、负插入。1、高、真、逻辑高、电源、VDD、正插入。X、不确定。逻辑冲突无法确定其逻辑值。x和X、z和Z不区别大小写。天津大学电子科学与技术系史再峰。0、低、伪。
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