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文档简介

一、课题要求：（1）技术要求：1、掌握多功能数字钟的工作原理。2、应用 EDA技术，VHDL 语言编写程序。3、层次化设计，设计原理框图。4,、硬件设计及排版。（2）功能要求：1、基本功能：能进行正常的时、分、秒计时功能，分别由 6个数码管显示 24小时、60 分钟、60 秒的计数器显示。2、 扩展功能：（1）能够利用按键实现“校时” “校分”“清零”功能。（2） 能利用扬声器做整点报时，整点前五秒短声，整点长声。（3）本人工作：负责软件部分,编写各部分模块的 VHDL 程序，并且锁定引脚，将程序下载到芯片中。二、设计方案：原理框图:数字钟原理框图一共有 11 个小模块：分频，片选，按键，小时，分，秒，显示模块，七段显示译码器，报时，扬声，36 译码器。左边第一个是时钟信号输入端，50Mhz 到分频模块。第二个为清零按键，第三个为校分按键，第四个为校时按键。右边第一个为七段显示译码器输出端，第二个为扬声器输出端，第三个为 6 个数码管输出端。数字电路课程设计报告中间模块为数字钟的核心，有计时，报时，校时功能。三、单元模块设计1、分频模块该模块是将时钟脉冲 50Mhz分频到 1000、500 和 1，分别给报时模块和及时模块。数字电路课程设计报告2、秒模块仿真图数字电路课程设计报告该模块为 60进制计数器，有分频模块得到的 1hz进行计时，计时输出为秒的数值，在计时到 59时进位 1到 co端。当按下 s3时，秒清零。3.、分模块仿真图数字电路课程设计报告该模块也为 60进制计数器，计时输出为分的数值。在 EN信号有效且时钟来时，计数器加 1、在 s2按下时，EN 使能端有效，实现校分功能。4、时模块仿真图该模块为 24进制计数器，计时输出为小时的数值，在 EN信号到来时，计数器数字电路课程设计报告加 1，在 S1按下时，EN 信号有效，实现校时功能。5、片选模块仿真图该模块提供数码管片选信号。数字电路课程设计报告6、按键模块仿真图该模块是有几个门电路组成，把它编写成一个模块，到时写程序方便。该模块连接几个按键，由按键控制。数字电路课程设计报告7、报时模块仿真图该模块为整点报时提供控制信号，当 59分时，秒为 50，52，54，56，58 时，Q500输出“1” ；秒为 00时，Q1000 输出“1” 。这两个信号经过逻辑门实现报时数字电路课程设计报告功能。8、BBB 模块仿真图数字电路课程设计报告该模块对应不同
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