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文档简介
1、在横线上填入合适的语句完成D触发器的设计。library ieee;use ieee.std_logic_1164.all;entity d_flip isport(d, clk: in std_logic; );end d_flip;architecture rtl of d_flip isbeginprocess( )begin if then ; ;end process; end rtl; 2、在横线上填入合适的语句完成2输入或非门的设计。library ieee;use ieee.std_logic_1164.all; nor2 is port(a,b:in std_logic;y:out std_logic); end nor2; architecture behave of is begin ;end behave;3、已知电路原理图如下，请用一个process和两个process两种方式完成程序设计P1344、已知电路原理图如下，请用VHDL完成程序设计P1345、设计一个带有异步清零功能的十进制计数器。计数器时钟clk上升沿有效、清零端CLRN、进位输出co。6、阅读下列VHDL程序，画出相应RTL图LIBRARY IEEE;USE IEEE.STD_LOGIC_1164.ALL;ENTITY TRIS ISPORT (CONTROL : IN STD_LOGIC;INN: IN STD_LOGIC;Q: INOUT STD_LOGIC;Y: OUT STD_LOGIC );END TRIS;ARCHITECTURE ONE OF TRIS ISBEGINPROCESS (CONTROL, INN, Q)BEGINIF (CONTROL = 0) THENY = Q;Q = Z;ELSEQ
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