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文档简介

实验七 设计一个四位可逆二进制计数器一、实验目的掌握中规模集成计数器的使用方法及功能测试方法。二、实验内容及要求用D触发器设计一个同步四位二进制可逆计数器。三、设计过程（1）根据题意列出加计数状态表和驱动表，如下表所示。序号现态次态Qn1Qn0Q n+11Q n+1000001101102101131100从绘图工具栏中选择直线工具，然后在要做上划线的文字上按住鼠标左键划到自己想终止的文字上松开鼠标左键就可以了！（2）求得各位触器的驱动信号的表达式 D1=（3）根据题意列出减计数状态表和驱动表，如下表所示。序号现态次态Qn1Qn2Q n+11Q n+1200011101102100131100（2）求得各位触器的驱动信号的表达式由上分析可知：加减计数只在于时钟CP的不同，若要使一个电路能够可逆计数，增设一控制开关，就可实现。设K1时为加计数，设K0时为减计数， 加法：CPn 减法：CPn 则有：CPn (或如 K=0时为加法： CPn K=1时为 减法： CPn 则有：CPn=） 四、可逆计数器逻辑图如下：四、实验用仪器、仪表 数字电路实验箱、万用表、74LS74、74ls86六、实验数据K=0K=1CPQ3Q2Q1Q0Q3Q2Q1Q000001111
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