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数字电子技术基础简明教程复习题一、填空1、(238)10( 11101110 )2 ( EE )16。(110110.01)2( 36.4 )16( 54.25 )10。2、德摩根定理表示为 ( ) , ( )。3、数字信号只有（ 两 ）种取值，分别表示为（ 0 ）和（ 1 ）。4、异或门电路的表达式是( )；同或门的表达式是( ) 。5、组成逻辑函数的基本单元是（ 最小项 ）。（见P17）6、基本逻辑门有（ 与门 ）、（ 或门 ）和（ 非门 ）三种。复合门有（ 与非门 ）、（ 或非门 ）、（ 与或非门 ）和（ 异或门 ）等。7、卡诺图中几何相邻的三种情况是（ 相接相邻 ）、（ 相对相邻 ）和（ 相重相邻（或称重叠相邻） ）。8、逻辑函数的公式化简的方法是（ 并项法 ）、（ 吸收法 ）、（ 消去法 ）和（ 配项消项法 ）等。9、最简与或式的定义是乘积项的（ 个数最少 ），每个乘积项中相乘的（ 变量个数也最少）的与或表达式。 .10、.除了与、或、非三种基本逻辑运算外，还有由这三种基本逻辑运算构成的四种复合逻辑运算，它们是（ 与非运算 ）、（ 或非运算 ）、（与或非运算 ）和异或运算。11、在正逻辑的约定下，“1”表示（ 高电平 ），“0”表示（ 低电平 ）。在负逻辑的约定下，“1”表示（ 低电平 ），“0”表示（ 高电平 ）。12、一般TTL门电路输出端( 不能 )直接相连，实现线与。(填写“能”或“不能”)13、三态门的三种可能的输出状态是( 高电平 )、( 低电平 )和( 高阻态 )。14、CMOS漏极开路门（OD门）的主要特点是（ 输出MOS管是开路的 ）；可以实现（ 线与 ）功能 ；可以用来实现（ 逻辑电平 ）变换 和（ 带负载能力强 ）。15、开门电阻Ron是指使反相器工作在（ 导通状态时所允许Ri 的最小值 ）；典型的TTL门电路Ron为( 2.5K )。16、关门电阻Roff是指使反相器工作在( 截止状态时所允许Ri的最大值 )；典型的TTL门电路 Roff为( 0.7k )。17、TTL与非门的多余输入端不能接（ 低 ）电平。18、门电路的负载分为( 拉电流 )负载和( 灌电流 )负载两大类。19、在多路传输过程中，能够根据需要将（ 其中任意一路挑选出来 ）的电路，叫做数据选择器，也称为多路选择器或多路开关。20、能够将（ 1个 ）输入数据，根据需要传送到（ m 个 ）输出端的任意一个输出端的电路，叫做数据分配器。21、组合逻辑电路的逻辑功能的特点是任何时刻电路的稳定（ 输出 ），仅仅只决定于该时刻（ 各个输入变量的取值 ）。22、一个十进制加法计数器需要由（ 4个 ）JK触发器组成。23、八输入端的编码器按二进制数编码时，输出端的个数是（ 3 ），四输入端的译码器的输出端的个数最多为 （ 16 ）。24、真值表是将输入逻辑变量的（ 所有可能取值 ）与相应的（ 输出变量函数值 ）排列在一起而组成的表格。25、组合逻辑电路是由（ 常用门电路 ）组合而成的，其中既无（ 从输出到输入的反馈连接 ），也不包含（ 可以存储信号的记忆元件 ）。26、触发器又称为双稳态电路，因为它具有（ 两个 ）稳定的状态。27、根据逻辑功能不同，触发器可分为（ RS触发器 ）、（ D触发器 ）、（ JK触发器 ）、（ T触发器 ）和（ T触发器 ）等。根据逻辑结构不同，触发器可分为（ 基本触发器 ）、（ 同步触发器 ）和（ 边沿触发器 ）等。28、JK触发器在JK00时，具有（ 保持 ）功能，JK11时；具有（ 翻转 ）功能；JK01时，具有（ 置0 ）功能；JK10时，具有（ 置1 ）功能。29、JK触发器具有（ 保持 ）、（ 置0 ）、（ 置1 ）和（ 翻转 ）的逻辑功能。D触发器具有（ 置0 ）和（ 置1 ）的逻辑功能。RS触发器具有（ 保持 ）、（ 置0 ）和（ 置1 ）的逻辑功能。 T触发器具有（ 保持 ）和（ 翻转 ）的逻辑功能。T触发器具有（ 翻转 ）的逻辑功能。30、边沿触发器具有共同的动作特点，即触发器的次态仅取决于CP信号（ 上升沿或下降沿 ）到来时刻输入的逻辑状态，而在这时刻之前或之后，输入信号的变化对触发器输出的状态没有影响。31、基本RS触发器的特性方程是（ ）；其约束条件是（ ）。JK触发器的特性方程是（ ）；D触发器的特性方程是（ ）；T触发器的特性方程是（ ）；T触发器的特性方程是（ ）。32、时序逻辑电路的逻辑功能的特点是任何时刻电路的稳定（ 输出 ），不仅和（ 该时刻的输入信号 ）有关，而且还取决于（ 电路原来的状态 ）。33、时序逻辑电路一定包含有作为存储单元的（ 触发器 ），时序电路中可以没有（ 组合 ）电路，但不能没有（ 触发器 ）。34、时序逻辑电路的逻辑功能通常可用（ 逻辑表达式 ）、（ 状态表 ）、（ 卡诺图 ）、（ 状态图 ）和（ 时序图 ） 等方式描述。35、在数字电路中，具有记忆功能的逻辑部件是（ 时序逻辑部件 ），不具有记忆功能的逻辑部件是（ 组合逻辑部件 ）。36、若ROM有5根地址输入线，有8根数据输出线，则ROM的字线数为（ 32 ），ROM的容量为（ 256 ）。37、把移位寄存器的（ 输出 以一定方式馈送到 ）串行输入端 ，即得到（ 移位寄存器型 ）计数器。38、移位寄存器型计数器的分类为（ 环形计数器 ）、（ 扭环形计数器 ）和（ 最大长度移位寄存器型计数器 ）。39、RAM与ROM比较，其优点是（ 读写方便，使用灵活 ）；缺点是（ 掉电丢失信息 ）。 40、顺序脉冲发生器可分成（ 计数型 ）和（ 移位型 ）两大类。41、多谐振荡器是一种（ 自激振荡 ）电路，当电路连接好之后，只要接通电源，在其输出端便可获得（ 矩形 ） 脉冲。42、555定时电路又称（ 时基电路 ），它巧妙地将（ 模拟功能 ）和（ 逻辑功能 ）结合在一块硅片上。43、最基本、最典型的脉冲产生整形电路有（ 施密特触发器 ）、（ 单稳态触发器 ）和（ 多谐振荡器 ）。44、555定时器由（ 分压器 ）、（ 比较器 ）、（ 基本RS触发器 ）、（ 晶体管开关 ）和（ 输出缓冲器 ）五部分组成。45、施密特触发器有两个稳定状态（ “0”态和“1”态 ），其维持与转换完全取决于（ 输入电压的大小 ）。46、单稳态触发器状态有一个（ 稳定状态 ）和一个（ 暂稳状态 ）。47、自激多谐振荡器的特点是没有（ 稳态 ），只有两个（ 暂稳态 ），两个（ 暂稳态 ）相互交替，无需外加触发信号，就能产生自激振荡 。 48、衡量D/A和A/D转换器性能优劣的主要指标都是（ 转换精度 ）和（ 转换速度 ）。49、A/D转换过程四个步骤的顺序是（ 采样 ）、（ 保持 ）、（ 量化 ）、（ 编码 ）。 50、AD转换器是把（ 模拟量 ）转换为（ 数字量 ）的转换器。D/ A转换器是把（ 数字量 ）转换为（ 模拟量 ）的转换器。 二、选择题1、数字电路中使用的数制是（ B ）。 A、十进制 B、 二进制 C、十六进制 D、八进制2、十进制数100对应的二进制数为（ C ）。A、1011110 B、1100010 C、1100100 D、110001003、ABC( C )。A、A B、BC C、(AB)(AC) D、AC4、对于n个变量而言，最小项共有( C )。A、2n B、n2 C、2n5、 两者的关系是( A )。A、 B、 C、 6、有三个输入端的或非门电路，要求输出高电平，其输入端应是( C )。A、全部为高电平 B、至少一个端为高电平 C、全部为低电平 D、至少一个端为低电平 7、具有“线与”逻辑功能的门电路有( B )。A、三态门 B、集电极开路门 C、与门 D、或门 8、对于负逻辑而言，某逻辑电路为与门，则对于正逻辑而言，该电路为( C )。A、与非门 B、或非门 C、 或门 D、与门9、集电极开路门(OC门)在使用时须在( B )之间接一电阻。A、输出与地 B、输出与电源 C、输出与输入10.一个两输入端的门电路，当输入为0和1时，输出不是1的门是（ B ）。 A、与非门 B、或非门 C、异或门 11、若在编码器中有50个编码对象，则要求输出二进制代码位数为( B )位。 A、5 B、6 C、10 D、5012、如需要判断两个二进制数的大小或相等，可以使用( D )电路。A、译码器 B、编码器 C、数据选择器 D、数据比较器13、八输入的编码器按二进制编码时，输出端的个数是（ B ）。 A、2个 B、 3个 C、4个 D、8个14、和数据分配器使用相同型号MSI的组合逻辑电路是( A )。见P194A、译码器 B、编码器 C、数据选择器 D、数据比较器15、扩展为5线-24线译码器所使用的74LS138的片数为( B )。见P179A、2片 B、3片 C、4片 D、5片16、数据分配器输入端的个数是( B )。A、2个 B、1个 C、4个 D、8个17、不能用来实现逻辑函数的组合逻辑电路是( C )。A、译码器 B、数据选择器 C、数据比较器 D、数据分配器18、不能用来消除竞争冒险的方法是( B )。A、引入选通脉冲 B、增加无关项 C、增加冗余项 D、接入滤波电容19、将1K 的RAM扩展为 8K 的RAM需用的组合逻辑电路是( B )。 A、2线-4线编码器 B、3线-8线译码器 C、2线-4线译码器 D、3线-8线编码器20、由与非门组成的RS触发器不允许输入的变量组合是（ A ）。 A、00 B、01 C、10 D、11 21、已知R、S是或非门构成的基本RS触发器输入端，则约束条件为( A )。A、RS0 B、R+S1 C、RS1 D、R+S0 22、不存在约束条件的同步触发器是( B )。A、同步RS触发器 B、同步D触发器 23、JK触发器欲在CP作用后保持原状态，则JK的值是( D )。A、JK11 B、JK10 C、JK01 D、JK0024、Mealy型时序逻辑电路的输出 ( C )。A、只与电路的现态有关 B、只与电路的输入有关C、与电路的现态和电路的输入有关 D、与电路的现态和电路的输入无关25、构成同步二进制计数器一般应选用的触发器是（ C ）。A、D触发器 B、RS触发器 C、JK触发26、构成四位寄存器应选用（ B ）。A、2个触发器； B、4个触发器 C、16个触发器27、需用( B )片74LS161构成六十进制计数器.A、1片 B、2片 C、3片 D、4片28、555构成的施密特触发器的回差电压UT为( D )。A、VCC B、VCC/2 C、2VCC/3 D、VCC/3 29、能起到定时作用的触发器是( C )。A、施密特触发器 B、双稳态触发器 C、单稳态触发器 D、多谐振荡器30、对电压、频率、电流等模拟量进行数字处理之前，必须将其进行( B )。A、D/A转换 B、A/D转换 C、直接输入 D、随意三、公式法化简、逻辑函数式展开成最小项表达式和卡诺图化简1、用公式法将下列逻辑函数表达式化简成为最简与或式2、将下列逻辑函数式展开成最小项表达式3、用卡诺图化简法将下列函数化简为最简与或表达式。 四、计算题1、图1所示电路中，D1、D2导通压降为0.7V，R10K。、uA接5V，uB接地时，uY等于多少伏？、uA接5V，uB接10V时，uY等于多少伏？ 2、图2所示电路中，D1、D2导通压降为0.7V，R10K。、uA接0V，uB接0V，uY等于多少伏？ R218kuO5V=30 R1 1.5kuIRC1k、uA接5V，uB接0V时，uY等于多少伏？ 3、电路如图3所示，试计算当uI分别为0V、3V uO的值。 uBD1D2uAuYRuBD1D2uAuYR+10V 图1 图2 图3五、作图题1、电路及CP、S、R的波形如图4所示，试对应画出的波形。P272页4.4题QQ 图42、边沿触发器及CP、J、K的波形如图5所示，试对应画出的波形。P272页4.5题QQ 图53、边沿触发器及CP、D的波形如图6所示，试对应画出的波形。P272页4.6题QQ 图64、电路及A、B和CP的波形如图7所示，试画出Q端的波形，设触发器的初始状态Q1。ABCP =1ABCPQDQABDQCP 图7CPABABCP1J1K&QQ6、已知JK触发器电路和A、B和CP的波形如图8所示，试画出JK触发器Q端的波形，设触发器的初始状态Q0。CPABJKQ图8六、分析题1、试分析图9所示电路的逻辑功能。2、试分析图10所示时序电路的逻辑功能。写出电路的激励方程、状态方程和输出方程，画出状态图，说明电路是否具有自启动特性。 图9 图103、试分析图11所示时序电路的逻辑功能。（各触发器的初始状态均为0。）4、试分析图12所示电路的逻辑功能。1&ABCY111Q1Q0CP&1J1KQQ1J1KQQZ1 图11 图12七、设计题1、用与非门设计一个组合逻辑电路，其输入是4位二进制数，当该数大于等于1010时输出为1，否则输出为0。2、有一水塔，由两台一大一小的电动机