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文档简介

基于QUARTUS的VHDL语言多功能数字钟注任何人不得作为商业用途数字钟的功能1）以24小时制显示时、分、秒计数；2）时间清零，时设置，分设置功能；3）整点报时功能。实验环境1软件环境QUARTUSII722硬件环境MAXIIEPM240T100C51分频器1KHZ分频器VHDLLIBRARYIEEEUSEIEEESTD_LOGIC_1164ALLUSEIEEESTD_LOGIC_UNSIGNEDALLENTITYFPQ1KISPORTCLKINSTD_LOGICQ1KHZOUTSTD_LOGICENDARCHITECTUREBEHAVOFFPQ1KISBEGINS1PROCESSCLKVARIABLECOUNT2INTEGERRANGE0TO50000BEGINIFCLK1ANDCLKEVENTTHENCOUNT2COUNT21IFCOUNT225000THENQ1KHZ“101“THENCOUNTDAOUTDAOUT3DAOUTDAOUT3DAOUTDAOUT3DOWNTO2“00“DAOUT1DOWNTO0HOUR5DOWNTO4DP0“101”时选择“时的各位”计数值显示，点不亮ENDCASEENDPROCESSENDBEHAVE动态显示模块顶层设计原理图7显示译码模块显示译码模块顶层设计原理图8总顶层电路总顶层电路设计原理图总结在此次的数字钟设计过程中，最终结果与预期效果基本一致更进一步地了解和熟悉有关数字电路的知识和具体的应用。学会了利用QUARTUS硬件描述语言VHDL编写程序。并能根据仿真结果分析设计的存在的问题和缺陷，从而进行程序的调试和完善。此次的数字钟设计重点在于报时模块的代码编写。通过这次的设计
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