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文档简介

1、计算机组成原理实验5 实验五微程序控制器的设计及实现 rom64_40.v module rom64_40 ( addr, q); input 5:0 addr; output 39:0 q; reg 39:0 q; always (addr5 or addr4 or addr3 or addr2 or addr1 or addr0) begin case(addr5,addr4,addr3,addr2,addr1,addr0) 6h00 : q 6h1b : q 6h28 : q 6h30 : q 6h38 : q default : begin end endcase end endmod

2、ule rom64_40.vt timescale 1 ns/ 1 ps module rom64_40_vlg_tst(); reg 5:0 addr; wire 39:0 q; rom64_40 i1 ( .addr(addr), .q(q) ); integer i; initial begin for(i=0;i #50 addr=i; end end endmodule rom64_40.bsf rom64_40.bsf仿真测试 reg6.v module reg6 ( clk,dout ,d,clr_ ); input clk ; wire clk ; input 5:0 d ;

3、wire 5:0 d ; input clr_; wire clr_; output 5:0 dout ; reg 5:0 dout ; always ( negedge clk or negedge clr_ ) begin if(clr_=0) dout dout endmodule reg6.vt timescale 1 ps/ 1 ps module reg6_vlg_tst(); reg clk; reg clr_; reg 5:0 d; wire 5:0 dout; reg6 i1 ( .clk(clk), .clr_(clr_), .d(d), .dout(dout) ); integer i; initial beg

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