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文档简介
1、南京信息工程大学 实验(实习)报告实验(实习)名称 按题要求设计存储器 日期 2012.4.21 得分 指导教师 马利 系 计软院 专业 计科 年级 2010 班次 1班 姓名 学号 一、实验目的综合使用Protel进行综合设计二、实验内容1.完成图纸设置(改图纸号)2.添加元器件库3.CPU采用8086,用4片8K*8位的ROM(采用2764)和10片8K*8位的RAM(采用6264)组成存储器,地址锁存器采用8282,数据缓冲器采用8286,控制信号为DT/R,译码器采用74ALS138;4.绘出完整的原理图。 三、实验练习题 某机器中,已知ROM区域的地址空间为0000H3FFFH(用8
2、K*8位的ROM芯片(2764)构成),RAM的起始地址为6000H,地址空间为40K*16位(用8K*8位的RAM芯片(6264)构成)。假设RAM芯片有CS和WE(上面有横杠)信号控制端,CPU(8086)的地址总线为A15A0,数据总线为D15D0,控制信号为T/W(W上面有横杠),MREQ(上面有横杠),(访存),要求、1。画出地址译码方案2。将ROM和RAM同CPU相连四、实验步骤 1.新建一个SCH文件;2.placepartBrowse选择8088;3.PlacePartsBrowse选择8282,添加两个; 4.PlacePartsBrowse选择8286,添加两个; 5.Pl
3、acePartsBrowse选择2764,连续添加四个;6.PlacePartsBrowse选择6264,连续添加十个;7.PlacePartsBrowse选择38译码器;8.所有元器件分布如图所示;9.划线并添加网络标签;CPU ALU-8282STB CPU DT/R*-8286T CPUDEN*-8286OE* CPURD*-6264、2764OE* CPU WR*-6264WE*10.将两个8282地址锁存器的OE/相连,并且接地;11.创建网络表 DesignCreate NetlistOK;12.新建一个PCB文件;13.在keepoutlayer层上划一个6*6的方格14.导入元器件 DesignLoad NetsBrowse添加文件,确定后Excute;15. 手动布置原件,使各元件排列整齐。直接相连的原件尽量往一起排列。16. 选择Auto RouteAllRoute All17.执行之后的图及布线条数如图所示。 五、实验总结 通过这一次的上机实习课,让我懂得了根据题目的意思去分析设计,在上一次的基础上把这些弄得更清楚了,
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