单片机IO口推挽输出与开漏输出的区别_第1页
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文档简介

1、单片机I/O 口推挽输出与开漏输出的区别(转)推挽输出:可以输出高,低电平,连接数字器件;开漏输出:输出端相当 于三极管的集电极.要得到高电平状态需要上拉电阻才行.适 合于做电流型的驱动,其 吸收电流的能力相对强(一般20ma 以内),推挽结构一般是指两个三极管分别受两互补信号的控制总是 在一个三极管导通的时候另一个截止.我们先来说说集电极开路输出的结构。集电极开路输出 的结构如图1所示,右边的那个三极管集电极什么都 不接, 所以叫做集电极开路(左边的三极管为反相之用,使输入为“ 0”时,输出也为“ 0” )。对于图1,当左端 的输入为“ 0”时,前面的三极管截止(即集电极C跟发 射极E之 间

2、相当于断开),所以5V电源通过1K电阻加 到右边的三 极管上,右边的三极管导通(即相当于一个开关闭合);当 左端的输入为“ F时,前面的三极管导通,而后面的三极 管截止(相当于开关断开)。我们将图1简化成图2的样子。图2中的开关受软件控 制,“1”时断开,“0”时闭合。很明显可以看出,当开关闭 合时,输出直接接地,所以输出电平为0。而当开关断开时,则输出端悬空了,即高阻态。这时电平状态未 知,如果后面一个电阻负载(即使很轻的负载)到地,那么输 出端的电平就被这个负载拉到低电平了,所以这个电路是不能 输出高电平的。再看图三。图三中那个1K的电阻即是上拉电阻。如果 开关 闭合,则有电流从1K电阻及

3、开关上流过,但由于开关闭其它 三个口带内部上拉),当我们要使用输入功能时,只要将输出 口设置为1即可,这样就相当于那个开关断开,而对于P0 口 来说,就是高阻态了。对于漏极开路(OD输出,跟集电极开路输出是十分类似 的。将上面的三极管换成场效应管即可。这样集电极就变成了 漏极,oc就变成了 OD原理分析是一样的。另一种输出结构是推挽输出。推挽输出的结构就是把上面 的上拉电阻也换成一个开关,当要输出高电平时,上面的开关 通,下面的开关断;而要输出低电平时,则刚好相反。比起 OC或者OD来说,这样的推挽结构高、低电平驱动能力都很 强。如果两个输出不同电平的输出口接在一起的话,就会产生 很大的电流,

4、有可能将输出口烧坏。而上面说的0C或0D输出则不会有这样的情况,因 为上拉电阻提供的电流比较小。如果是推挽输出的要设置为高 阻态时,则两个开关必须同时断开(或者在输出口上使用一个 传输门),这样可作为输入状态,AVR单片机的一些10 口就是这种结构。开漏电路特点及应用在电路设计时我们常常遇到开漏(open drai n)和开集(open collector )的概念。所谓开漏电路概念中提到的“漏”就是指 MOSFE的 漏极。同理,开集电路中的“集”就是指三极管的集电极。开 漏电路就是指以M0SFE的漏极为输出的电路。一般的用法是 会在漏极外部的电路添加上拉电阻。完整的 开漏电路应该由开 漏器件

5、和开漏上拉电阻组成。如图1所示:组成开漏形式的电路有以下几个特点:利用外部IC内部1.电路的驱动能力,减少的驱动(或驱动比芯片电源电压高的负载)。当IC内部MOSFE导通时,驱动电流是从外部的VCC流经R pull-u p,MOSFE到GND IC内部仅需很下的栅极驱动电流。如图1。2. 可以将多个开漏输出的Pin,连接到一条线上。形成“与逻辑”关系。如图1, 当PIN_A、PIN_B PIN_C任意一个变低后,开漏线上的逻辑就 为0 了。这也是12G SMBuS等总线判断总线占用状态的原理。如果作为输 出必须 接上拉电阻。接容性负载时,下降延是芯片内的晶体管,是有 源驱动,速度较快;上升延是

6、无源的外接 电阻,速度慢。如果 要求速度高电阻选择要小,功耗会 大。所以负载电阻的选择要 兼顾功耗和速度。3.可以利用改变上拉电源的电压,改变传 输电 平。如图2, IC的逻辑电平由电源Vccl决定,而输 出高电平 则由Vcc2 (上拉电阻的电源电压)决定。这样 我们就可以用 低电平逻辑控制输出高电平逻辑了(这样你就可以进行任意电 平的转换)。(例如加上上拉电阻就可以提供TIL/CMOSfe平 输出等。)4.开漏Pin不连接外部的上拉电阻,则只能输出低电 平 (因此对于经典的51单片机的P0 口而言,要想做输入 输出 功能必须加外部上拉电阻,否则无法输出高电平逻辑)。一般 来说,开漏是用来连接

7、不同电平的器件,匹配 电平用的。5 .标准的开漏脚一般只有输出的能力。添加其它的判断电路,才能具备双向输入、输出的能力。6 .正常的CMO输出级是上、下两个管子,把上 面的管子去掉就是OPEN-DRAI 了。这种输出的主要目的有两 个:电平转换、线与。7 .线与功能主要用于有多个电路对同一信号进行拉低操 作的场合,如果本电路不想拉低,就输出高电平,因为OPEN- DRAI I 上面的管子被拿掉,高电平是靠外接的上拉电阻实现 的。(而正常的CMO输出级,如果出现一个输出为高另外一 个为低时,等于电源短路。)提供了灵活的输出方式,但是也有其弱点,就是带来上升 沿的延时。因为上升沿是通过外接上拉无源

8、电阻对负载充电, 所以当电阻选择小时延时就小,但功耗大;反之延时大功耗 小。所以如果对延时有要求,则建议用下降沿输出。应用中需注意:1 .开漏和开集的原理类似,在许多应用中我们利用开集电路代替开漏电路。例如,某输入 Pin要求由开漏电路驱动。则我们常见的驱动方式是利用一个 三极管组成开集电路来驱动它,即方便又 节省成本。如图3。2 .上拉电阻R pull-up的阻值决定了逻辑电平转换的沿的速度。阻值越大,速度越低功耗越 小。反之亦然。Push-Pull输出就是一般所说的推挽输出,在CMOS电路 里面应该较CMO输出更合适,因为在CMOS!面的p ush pull 输出能力不可能做得双极那么大。

9、输出能力看IC内部输出极N 管P管的面积。和开漏输出相比,push -pull的高低电平由 IC的电源低定,不能简单的做逻辑操作等。push pull是 现在CMO电路里面用得最多的输出级设计方式。当然open drain也不是没有代价,这就是输出的驱动 能力 很差。输出的驱动能力很差的说法不准确,驱动能力取决于 IC中的末级晶体管功率。0D只是带来上升沿的 延时,因为上 升沿是通过外接上拉无源电阻对负载充电的,当电阻选择小时 延时就小、但功耗大,反之延时大功耗小。OPEN DRAIN提供 了灵活的输出方式,但也是有代价的,如果对延时有要求,建 议用下降沿输出。电阻小延时小的前提条件是电阻选择的原则应在末级晶体 管功耗允许范围内,有经验的设计者在使用逻辑芯片时,不会 选择1欧姆的电阻作为上拉电阻。在脉冲的 上升沿电源通过上 拉无源电阻对负载充电,显然电阻越小上升时间越短,在脉冲 的下降沿,除

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