微机原理与接口技术5-8086,8088工作原理课件

1第二章(2)

8086/8088工作原理

计算机科学与技术学院体系结构中心2内容提要8086/88CPU管脚定义8086/88CPU总线周期和操作时序8086/88CPU工作模式8086/88CPU存储器接口计算机科学与技术学院体系结构中心31.管脚定义计算机科学与技术学院体系结构中心58086/88管脚功能AD15-AD0分时复用地址（ALE=1）/数据总线（ALE=0）A19/S6-A16/S320位地址线的高4位或状态线S6-S3M/IO标识地址线用作存储器地址还是IO地址RD读信号，低电平有效WR写信号，低电平有效计算机科学与技术学院体系结构中心6分时复用的概念分时复用就是一个引脚在不同的时刻具有两个甚至多个作用最常见的总线复用是数据和地址引脚复用总线复用的目的是为了减少对外引脚个数8088/8086CPU的数据地址线采用了总线复用方法计算机科学与技术学院体系结构中心78086/88管脚功能（续）ALE地址锁存允许信号。高电平表示地址数据总线上传送的是地址DT/R

数据发送/接收控制信号DEN数据允许信号INTR当为1且IF=1时，CPU准备进行中断服务。在当前指令执行完后INTA变为低电平以响应中断。计算机科学与技术学院体系结构中心98086/88管脚功能（续）MN/MX工作模式选择信号BHE

总线高字节有效。在读或写操作期间，使能数据总线的高8位READY准备好信号。用于在CPU的总线周期中插入等待状态。该信号由存储器或I/O设备产生。RESET复位信号。高电平持续4个时钟周期以上才有效。计算机科学与技术学院体系结构中心108086/88管脚功能（续）TEST测试信号。当CPU执行WAIT指令时，每5个CLK检测管脚，若为1，则等待；否则执行下一条指令。在使用协处理器8087时，通过引脚和WAIT指令，可使8088与8087的操作保持同步

HOLD

总线请求信号HLDA总线请求响应信号RO/GT1和RO/GT0在大模式下，用于请求/证实DMA操作计算机科学与技术学院体系结构中心118086/88管脚功能（续）LOCK总线锁定信号。由指令前缀激活。QS1和QS0

队列状态信号。用于标识内部指令队列的状态。计算机科学与技术学院体系结构中心138086/88管脚功能（续）

S2、S1和S0指示当前总线周期的功能计算机科学与技术学院体系结构中心142.总线周期及时序计算机科学与技术学院体系结构中心15基本概念时序（Timing）是指信号高低电平（有效或无效）变化及相互间的时间顺序关系。总线周期是指CPU完成一次访问存储器（或I/O端口）的操作所需要的时间。对于8086/88CPU，基本总线周期包括4个时钟周期（T1~T4）。这个时钟周期也称为T状态。Ti是在两个总线周期之间插入的空闲时钟周期

T1T2T3T4TiTi

T1T2T3TwTwTwT4TiTi

总线周期总线周期若干个1~2个计算机科学与技术学院体系结构中心178086写总线周期计算机科学与技术学院体系结构中心188086读总线周期计算机科学与技术学院体系结构中心198086读操作时序主频：5Mhz计算机科学与技术学院体系结构中心218086时序（续）T4状态T4的前沿采样数据总线。然后，所有总线信号变为无效，为下一总线周期做好准备。计算机科学与技术学院体系结构中心22READY信号线的使用T3Tw8086在访问慢速存储器或I/O设备时需要在T3和T4之间插入一个或多个等待状态Tw。存储器或I/O设备是通过READY信号来控制是否要插入Tw状态。Sampledagain计算机科学与技术学院体系结构中心233.工作模式计算机科学与技术学院体系结构中心25最小模式存储器外设DENDT/RAD15-0BHEA19-16ALEM/IOWRRDCLKREADYRESET8086CPUMN/MX+5V+5VBHERES82848282STBOE8286TOEDataBusAddr.Bus计算机科学与技术学院体系结构中心26带三态缓冲的8位数据锁存器8282QDCLKQDCLKQDCLKDI0DI1DI7STBDO0DO1DO7OESTB：选通脉冲OE：为0时输出有效为1时输出为三态计算机科学与技术学院体系结构中心29最大模式在最大模式下，下列管脚将被重新定义：ALEWRM/IODT/RDENINTAHOLDHLDA这需要增加8284总线控制器来产生相应的控制信号。计算机科学与技术学院体系结构中心30最大模式A16-19计算机科学与技术学院体系结构中心318288总线控制器计算机科学与技术学院体系结构中心324.存储器接口计算机科学与技术学院体系结构中心338086存储器特点数据总线16位，地址总线20位，可寻址空间为1M字节。利用BHE信号线，可按字节或字寻址计算机科学与技术学院体系结构