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锁相环的设计

一种自偏置锁相环的设计及其噪声性能研究 学 科 专 业。CMOS高速锁相环的研究与设计。学 院。摘要 摘要 无线通信系统的快速发展。而锁相环作为频率合成器的主要实现方式。本课题主要研究的是有关锁相环电路仿真模型的研究方法。深入探讨了锁相环的组成和工作原理及在各种电路中的应用。

锁相环的设计Tag内容描述:<p>1、收稿日期: 2008212202 基金项目:国家自然科学基金资助项目(60776023) ;国家 “八六三” 高技术研究发展计划资助项目(2007AA01Z285) 作者简介:谭 聪(1984 ) , 男,硕士研究生.通讯联系人:唐璞山,男,教授,E2mail : pstang fudan. edu. cn. 文章编号: 042727104(2009)0420470207 一种改进的用于FPGA的快速 数字锁相环电路设计 谭 聪,卜海祥,唐璞山 (复旦大学 专用集成电路与系统国家重点实验室,上海201203) 摘 要:设计了一种可以用于FPGA的数字锁相环的集成电路结构.传统的快速逼近设计方法因仅采用单层次 的设计架构,会面临延迟单元数目与精。</p>
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