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文档简介

MIPS CPU设计,南开大学一队 组员：李浩宇 林志翔,龙芯杯,指导老师：李涛 董前琨,肆,叁,壹,贰,综述,CPU设计,系统移植,作品展示,壹,综述,提交作品概述,壹,采用经典五级流水架构 对于数据相关采用旁路的方式解决 实现Icache和Dcache以及TLB 成功启动PMON,贰,CPU设计,CPU设计,贰,CPU core,单发射静态五级流水CPU 实现了61条MIPS指令 EXE、MEM、WB级旁路 在WB级进行中断异常处理 实现了TLBR、TLBWI、TLBP指令,CPU设计,贰,L1 cache,Cache均为8K，读写分离 使用分布式ram实现cache，当拍完成数据传递 Icache为直接映射，块大小为16字，实现提前启动 Dcache为两路组相联，块大小为1字，写回写分配，LRU替换算法 实现写buffer，增加cache命中率,CPU设计,贰,性能分数,叁,系统移植,系统移植,叁,利用了龙芯杯大赛发布的run_os环境，完成了对串口、网口、SPI等外设的响应 添加了TLB、CACHE指令，以及一个32项的ITLB、DTLB支持PMON的initmips 添加了SYNC等其他指令，支持PMON的其他命令,CPU扩展,查看反汇编代码 查看PMON源码 指令和CP0是否缺失 利用printf定位,系统移植,叁,调试方法,肆,作品展示,作品展示,肆,成功启动PMON，并对PM
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