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文档简介

实验二用PLD实现组合逻辑电路,用QUARTUSII软件环境设计、仿真、下载、实验验证逻辑功能1.3-8译码器2.BCD-7段译码器3.用十六进制全加器实现十进制全加器,CPLD应用讲授內容,CPLD的简介EDA工具QUARTUSII快速入门电脑辅助数字电路设计3-8译码器设计、实现过程,CPLD集成单元的內部结构,FPGA/CPLD的制造技术,FPGA/CPLD以CMOS为制作程序目前共有EPROM、EEPROM、FLASH、SRAM及Anti-Fuse等五种制造技术。,QUARTUSII设计流程,数字逻辑电路设计环境,1、建立项目,选择File,2、设计输入,双击空白处,选择器件,完成图形输入,3、编译项目,4、仿真项目,双击左键,双击左键,存盘,5、引脚分配,存盘，再编译,6、下载,实验报告要求,总结QUARTURSII操作步骤设计过程及原理电路图测试结果或仿真波形图预习1、用VerilogHDL设计七段译码器2、用十六进制全加器实现十进制全加器,
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