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文档简介
.AHB总线协议 1. 简介 AHB总线规范是AMBA总线规范的一部分,AMBA总线规范是ARM公司提出的总线规范,被大多数SoC设计采用,它规定了AHB (Advanced High-performance Bus)、ASB (Advanced System Bus)、APB (Advanced Peripheral Bus)。AHB用于高性能、高时钟频率的系统结构,典型的应用如ARM核与系统内部的高速RAM、NAND FLASH、DMA、Bridge的连接。APB用于连接外部设备,对性能要求不高,而考虑低功耗问题。ASB是AHB的一种替代方案。1.1 AHB总线的架构 AHB总线的强大之处在于它可以将微控制器(CPU)、高带宽的片上RAM、高带宽的外部存储器接口、DMA总线master、各种拥有AHB接口的控制器等等连接起来构成一个独立的完整的SOC系统,不仅如此,还可以通过AHB-APB桥来连接APB总线系统。AHB可以成为一个完整独立的SOC芯片的骨架。 下图是一个典型的AHB系统总线的结构示意图1.2 AHB基本特性Burst传输Split事务处理单周期master移交单一时钟沿操作无三态更宽的数据总线配置(64/128)流水线操作可支持多个总线主设备(最多16个)2. AHB总线的组成 AHB总线由Master、Slave和Infrastructure构成。Infrastructure由arbiter、数据多路、地址控制多路、译码器构成。主设备Master发起一次读/写操作某一时刻只允许一个主设备使用总线从设备Slave响应一次读/写操作通过地址映射来选择使用哪一个从设备仲裁器arbiter允许某一个主设备控制总线译码器decoder通过地址译码决定选择哪一个从设备总线可以分为三组 写数据总线(HWDATA) 读数据总线(HRDATA) 地址控制总线(HADDR)3. 信号描述NameSourceToDescriptionHCLKclock source各module总线时钟,上升沿采样HRESETnreset controller各module总线复位,低电平有效HADDR31:0Masterdecodermux to slavearbiter32位系统地址总线HTRANS1:0Mastermux to slave当前传输类型NONSEQ, SEQ, IDLE, BUSYHWRITEMastermux to slave1为写,0为读HSIZE2:0Mastermux to slave每一个transfer传输的数据大小,以字节为单位,最高支持1024位HBURST2:0Mastermux to slaveburst类型,支持4、8、16 burst,incrementing/wrappingHPROT3:0Mastermux to slave保护控制信号,需要slave带保护功能,一般不用HWDATA31:0Mastermux to slave写数据总线,Master到SlaveHRDATA31:0Slavemux to master读数据总线,Slave到MasterHREADYSlavemux to masterarbiter高:Slave指出传输结束低:Slave需延长传输周期HRESP1:0Slavemux to masterarbiterSlave发给Master的总线
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