数字逻辑设计及应用 专科3 答案.pdf

1 电子科技大学网络教育考卷 电子科技大学网络教育考卷 C C卷 卷 20 年至 20 学年度第 学期 20 年至 20 学年度第 学期 考试时间 年 月 日 120 分钟 课程 数字逻辑设计及应用 专科 教师签名 大题号 一一 二二 三三 四四 五五 六六 七七 八八 九九 十十 合合 计计 得 分 一 选择题 每题 2 分 共 20 分 1 正逻辑和负逻辑之间的关系是 对偶关系 反演关系 相等关系 互补关系 2 或非逻辑的对偶逻辑是 与非逻辑 与逻辑 或逻辑 异或逻辑 3 如果实现 5 32 的译码器电路 需要 个 74138 3 8 译码器 来实现 2 3 4 8 4 要实现 8 选 1 的数据选择器 则地址输入 选择输入 和多路数据端得个数分别为 8 3 3 8 8 8 3 3 5 逻辑式 DCB A 的反演式是 DC BA DC BA DCBA DC BA 6 下面描述方法 对于一个组合逻辑而言 具备唯一性的是 逻辑函数式 真值表 卡诺图 逻辑电路图 7 如果用触发器和门电路来实现 12 进制的计数器 则至少需要 个触发器 2 个 3 个 4 个 5 个 8 下面触发器中 只能实现保持和翻转两种状态更新方式的触发器是 JK 触发器 D 触发器 SR 触发器 T 触发器 9 下面能够直接用于线与的集成门电路为 三态门 传输门 OC 门 与门 10 下面各个组成部分 对于一个时序逻辑来说 不可缺少的是 mealy 型输出 输入 moore 型输出 存储单元 二 填空题 每空 1 分 共 10 分 1 A 1 A A 0 A 2 2810 11100 2 34 8 1C 16 00110100 8421BCD 3 某状态机的状态数为 129 请问至少需要 8 位编码才能完成 4 如果要从多路输入数据中 选出一路作为输出 应采用 数据选择 器来实现 5 如果要比较两个二进制数的大小 应采用 比较 器来实现 6 如果待实现的时序状态机中存在状态循环圈 应采用 计数 器来实现 三 判断题 每题 1 分 共 10 分 1 CAABBCDEFGHCAAB 等式成立 2 所有最小项之和为 1 3 组合逻辑静态冒险产生的原因是由于逻辑信号的竞争 4 TTL 逻辑比 CMOS 逻辑的运行功耗更低 所以更利于集成 5 二进制译码器是一种时序电路 6 因为 D 触发器的特性方程为 所以任何时刻其状态输出 Q 都等于 D DQ 1n 7 移位寄存器也可以构建成计数器 8 对于 RS 触发器而言 使用时输入不必受到约束 9 时序逻辑中状态化简的目的在于降低成本 10 移位寄存器型计数器的反馈函数的输出对应着该移位寄存器的串行输入端 四 利用卡诺图化简 7 分 请将该逻辑化简成最简的与或函数式 F A B C D m 0 2 3 5 7 8 10 11 13 DBCBCDADBCF 或者 DBCBBDADBCF 五 时序逻辑设计 要求如下 8 分 利用一个 D 触发器和一定的门电路实现 JK 触发器的逻辑功能 具体要求如下 1 写出所选触发器的激励方程 2 画出逻辑图 密 封 线 姓名 专业名称 班号 学号 教学中心 六 时序逻辑设计 要求如下 15 分 采用 mealy 型时序逻辑电路设计一个 101 串行数据检测的时序逻辑电路 并利用 D 触发器实现该逻辑 具体 要求如下 1 画出状态转换图并进行化简 2 写出状态方程 3 写出激励方程和输出方程 4 画出逻辑电路图 2 状态图状态图 状态表状态表 状态方程和输出方程状态方程和输出方程 1XQY X0Q 0QX1Q 激励方程激励方程 XD0Q 0QXD1Q 电路图略电路图略 七 时序逻辑分析 要求如下 15 分 逻辑电路图如图 7 所示 具体要求如下 1 写出激励方程 2 写出输出方程 3 写出状态方程 4 画出状态转换图或者状态转换表 图 7 解答 1Q2Q1XQ1Q1K1Q1J1Q 1Q2Q2XQ2Q2K2Q2J2Q 2 状态方程 3 状态表 或者状态图 以上图表任画一个即得分 3 利用 D 触发器和一定的门电路 设计一个六进制的二进制加计数器 具体要求如下 2 写出状态方程 激励方程和输出方程 八 时序逻辑设计 要求如下 15 分 输出方程 在状态 101 产生输出有效 输出方程 在状态 101 产生输出有效 0Q1Q0Q1Q2Q1D1Q 0Q2Q0Q1Q2D2Q 3 画出逻辑电路