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实验二 组合逻辑电路的设计一、实验目的1 设计8段译码器、两路4位二进制比较器，并在实验装置上验证所设计的电路；2 学习用VHDL语句进行逻辑描述。二、实验要求 用VHDL设计8段译码器、两路4位二进制比较器，对CPLD器件进行配置及下载来验证自己的设计，验证电路的外围器件可选用按键输入、指示灯输出。8段译码器的逻辑功能输入输出in3.0dpgfedcba000111111100000110201011011301001111401100110501101101601111101700000111801111111901101111A01110111B01111100C00111001D01011110E01111001F01110001两路4位二进制比较器逻辑功能输入输出a3.0b3.0HLEa3.0 b3.0100a3.0 b3.0010a3.0= b3.0001三、设计方案按键的状态作为输入，输出对应数字的编码，连接到数码管上面可以看到数码管显示对应的数值。代码：LED.vhdlibrary ieee;use ieee.std_logic_1164.all;use ieee.std_logic_unsigned.all;entity LED isport(number:in std_logic_vector(3 downto 0); ledout:out std_logic_vector(7 downto 0);end;architecture u1 of LED isbeginwith number selectledoutnumberb then compout=100;-大于elsif numbera=numberb then compout=010;-等于else compout=001;-小于end if;power=1;end process;end;引脚配置实验
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