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文档简介

EDA技术与应用实验报告 实验名称:格雷码、二进制转换电路一、 实验目的1、学习使用VHDL代码组合逻辑电路的方法。2、掌握when.else.和generate并行语句的使用。二、 实验内容1、学习VHDL代码修改。2、利用case语句描述4位格雷码/二进制码转换电路,要求将输入输出的数据用数码管显示。 。3、利用generate并行语句描述n位格雷码/二进制码转换电路(n=4)。4、利用实验箱验证所设计电路的正确性,要求将输入输出的数据用七段数码管显示。三、 实验原理1、4位格雷码转换为二进制表达式为:四、 实验代码library ieee ;use ieee.std_logic_1164.all; use ieee.std_logic_arith.all;use ieee.std_logic_unsigned.all;entity gtob isport(g:in std_logic_vector(3 downto 0);b:buffer std_logic_vector(3 downto 0);end gtob;architecture rhg of gtob isbeginb=0000when g=0000else0001when g=0001else0011when g=0010else0010when g=0011else0111when g=0100else0110when g=0101else0100when g=0110else0101when g=0111else1111when g=1000else1110when g=1001else1100when g=1010else1101when g=1011else1000when g=1100else1001when g=1101else0011whe

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