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文档简介

1、得分评卷人一、 基本题：（23分）1十进制数(53.634)10 对应的二进制数为(110101.1010 )（2分）2十六进制数 (2A ) 对应的十进制数为(42)10 (2分)3.十进制数(25)10可表示为“8421BCD”码（00100101）(2分) 4RAM基本结构包含（地址译码器、存储矩阵、读写电路）三大部分。（2分）5.一块ROM芯片有10个地址输入端，有8个数据输出端，该ROM芯片的容量是（）bit。6A/D转换的基本步骤是（取样、保持、量化、编码）。（2分）7有一个6位的D/A转换器，设满度输出为6.3V，输入数字量为110111，则输出模拟电压为（5.5）V。（2分）8

2、为实现图1-1所示的逻辑功能，多余的C输入端应该接（ 高 ）电平。 （2分）图1-19对于负逻辑而言，某逻辑电路为与门，则对于正逻辑而言，该电路为（ 或门 ）。 （2分）（1）与非门（2）与门（3）或非门（4）或门10（ 1 ） （2分）（1）0（2）1（3）（4）A+B+C11.冒险现象的排除办法有：（增加滤波电路）、（增加冗余项）、（加选通脉冲）. (3分)二（17分）化简逻辑函数1（6分）用代数法化简F，并要求用最简与或式表示。2（6分）用卡诺图化简F，并要求用最简与或式及最简或与式表示。，给定约束条件。3（5分）已知逻辑函数F(A,B,C)=+AC+B写出F的标准或与式。解：3（2分）

3、（1）或（2）占2分，（3）占1分；若单独写出第(3)式得3分三（12分）试用38线译码器（逻辑符号如图3-1所示，输出为低电平有效）和合适的最少个逻辑门电路产生如下逻辑函数。图3-1解：取，则得到满足要求的逻辑图如图3-2所示。四 （12分）设计一个模6同步计数器，状态图如图41所示，采用如图42所示的下降沿触发的JK触发器设计，写出完整的设计过程。 图41 图42解：次态K图（2分）（2分）（2分）（2分）（2分）画出逻辑图（2分）五. （12分）电路图如图5-1所示，设初态，试画出其工作状态转换真值表，描述电路的功能，并检查能否自启动。图5-1解：六. （12分）2564bitROM逻辑符合如图6-1所示，试用此芯片构成容量为5128bit的存储器，并加以简要说明。图6-1解（构成2568bit存储器4分，与二组2568bit存储器选通端连接4分，整体5128bit存储器4分）七（12分）完成图7-1功能，使其成为序列信号发生器，其输出序列为010011

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