110序列检测器的设计及仿真实现_第1页
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文档简介

1、题目：设计110序列检测器，当输入信号时输出，否那么设计思路我们采用Moore机完成这个功能。对于触发器的选择，为了简便我们选用D触发器以及根本的门电路完成根本设计。时钟同步状态机 1根据题目要求我们得到下面的状态图状态表示的意义 Q X=0 X=1 输出Z等待1的出现 A A B 0出现1 B A C 0出现11 C D C 0出现110 D A B 1 2 转移输出表输入X输出ZX=0X=100000100100110111011010000113 状态图如图：通过卡诺图化简可得转移方程：输出方程：我们选择D触发器作为记忆电路局部 由D触发器的特征方程:得鼓励方程：三、Verilog程序如

2、下：module shiyan2 (clk,x,z);input clk,x;output z;wire1:0 state;wire1:0 excite;nextlogic u1(x,state,excite);statememory u2(clk,excite,state);outputlogic u3(state,z);endmodulemodule statememory (clk,d,q);input clk;input1:0 d;output1:0 q;reg1:0 q;always (posedge clk) begin q = d;endendmodulemodule nextlogic (x,q,d);input x; input1:0 q;output1:0 d;assign d0=(q1&q0)|(q1&x); assign d1=x;endmodulemodule outputlogic (q,z);input1:0 q;output z;assign z=(!q1)&q0;Endmodule四、仿真结果及电路图得到功能仿真结果为：时序仿真结果

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