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文档简介

一、实验名称：基于FPGADDS设计一个直接数字频率合成一、实验名称：基于FPGADDS设计一个直接数字频率合成(DDS，DirectDigitalSynthesis)，DDS新型的频率合成技术。DDSDACDDS本实验有三个输入端口，88键，88个开关按键，系统时钟输入端8D/A的输入端口。FPGA板上的时钟频率为50MHz105MHz再使用。1.DDSDDSDAC1：DDS1：DDS1DDSCPLD/FPGAMDDS输出正(余)ROM中，内部存有一个周期的正弦波信号的数字幅度信息，每个查找址信息映射成正(余)DAC的输入端，DAC(LPF)，可得到一个频谱纯净的DDSclk，NMN相加，把相加后的结果送至累M相加；另一方面将这个值作为取样地址值送入幅度/相位转换电路，此电D/A转换器和低通滤波器将波形DDS输出信号的频率由下式决定：q=(2M2N)×clk2M代表基准时钟频率)MDDS的频率分辨率定义为：q=clk2N由于基准时钟一口（16个开关按键），8口（16个开关按键），8位数据输出端口（D/A8位输入端口），复位输入端（接一个按键），分频后的时钟输出（D/A的时钟输入）。（50MHZ）址地址，N=N+M；address=N+PN0；M位频率控制字；address为寻址地址。模块端口有：时钟输入端口（5MHz时入端口），地址输出端口（rom模块，8位）。址地址，N=N+M；address=N+PN0；M位频率控制字；address为寻址地址。模块端口有：时钟输入端口（5MHz时入端口），地址输出端口（rom模块，8位）。81928的正弦波形数字信号（255）%存储单元数%8位%0~pi/2Sin值%以"wt"的形式打开,\n%sinrom.hexfprintf(fidc,'data_radix=分频后时钟romfprintf(fidc,'%d\n',round(125*sin(pi*(x-quartusMATLABrom应的.Vrom模块。本模块的功能是通过传送过来的地址，查找地址所fprintf(fidc,'%d\n',round(125*sin(pi*(x-quartusMATLABrom应的.Vrom模块。本模块的功能是通过传送过来的地址，查找地址所端口（8位）。分频后

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