数字电路的FPGA设计与实现-基于Quartus Prime和Verilog HDL-第11讲-数据选择器设计_第1页
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第11讲-数据选择器设计1数字电路的FPGA设计与实现——基于QuartusPrime和VerilogHDLFPGADesignandImplementationofDigitalCircuits——BasedonQuartusPrimeandVerilogHDL实验原理ExperimentalPrinciples“11.12MSI74151数据选择器

MSI74151是一个互补输出的八选一数据选择器，逻辑符号如图所示，它有三个数据选择端，八个数据输入端，两个互补数据输出端，一个低电平有效的选通使能端。3MSI74151真值表

4输入输出1×××0100000100001001100001010100110111MSI74151与外部电路连接图

右图为MSI74151与外部电路的连接图，其中输入端S、A0～A2、D0～D7使用拨动开关SW0～SW11来控制电平高低，对应EP4CE15F23C8N芯片引脚依次为W7、Y8、W10、V11、U12、R12、T12、T11、U11、Y10、V9、W8，输出端Y、Yn使用LED0、LED1表示，点亮为高电平，熄灭为低电平，对应EP4CE15F23C8N芯片引脚依次为Y4、W6。5实验步骤ExperimentalProcedure“11.26实验步骤7步骤1：新建原理图工程步骤2：添加MSI74151_top.bdf文件步骤3：添加仿真文件步骤4：引脚约束步骤5：新建HDL工程步骤6：完善MSI74151.v文件仿真波形8本章任务ChapterTask“11.39本章任务10任务1：基于原理图，用MSI74151和必要的门电路设计一个组合逻辑电路，该电路有3个输入逻辑变量A、B、C和1个工作状态控制变量S。当S=0时电路实现“意见一致”功能，即A、B、C状态一致时输出为1，否则输出为0。当S=1时电路实现“多数表决”功能，即输出与A、B、C中多数的状态一致。任务2：查阅MSI74153数据手册，根据MSI74151真值表，使用VHDL实现MSI74153，其中输入使用拨动开关，输出使用LED。任务3：与数据选择器正好相反，数据分配器的逻辑功能是将一个输入信号根据选择信号的不同取值，传送至多个输出数据通道中的某一个。尝试使用Quartus集成开发环境，基于原理图，用MSI74138实现一路-八路数据分配器，其中输入使用拨动开关，输出使用LED。提示：将MSI74138的S

̅_2作为数据输入端。本章习题ChapterExercises“11.411本章习题12

1.人类有四种基本血型：A，B，AB和O型，其中，O型血可以输给任意血型的人，而他自己只能接受O型；AB型可以接受任意血型，但他只能输给AB型；A型能输给A型或AB型，可接受A型或O型；B型能输给B型或AB型，可以接受B型或O型。使用8选1数据选择器实现血型匹配验证电路的功能，当输血者和受

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