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文档简介

实验四实验内容：组合逻辑电路设计1. 设计要求：用两片7400设计一个4输入的多数表决电路，即在4人或3人表决为1时通过，否则不通过。设计步骤：设计要求真值表卡诺图简化逻辑表达式逻辑图接线图调试检验2. 用7400实现一位半加器，即不考虑来自低位的进位。3. 用双四选一数据选择器74153来实现三人表决电路（不用门电路）。4. 设计一个锁。锁的可以由设计者自行设定，设该锁有规定的4位二进制代码A3A2A1A0的输入端和一个开锁钥匙信号B的输入端，当B=1（有钥匙插入）且符合设定的时，允许开锁信号输出Y1=1（开锁），报警信号输出Y2=0；当有钥匙插入不对时，Y1=0，Y2=1（报警）；当无钥匙但是对否，Y1=Y2=0。插入时，无论提示：1.设定四位P3P2P1P02.判断的对错就是判断两个二进制数P3P2P1P0与A3A2A1A0是否相等。3.备用芯片：7400，7420， 7486 ，74138，74153。可以选择其中的一种或多种芯片来完成设计。7486

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