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信号是单向传输的,不存在任何反馈回路。时序逻辑电路:若逻辑电路在任何时刻产生的稳定输出信号不仅与电路该时刻的输入信号有关,还与电路过去的输入信号有关,则称为时序逻辑电路。时序逻辑电路具有如下特征: 电路由组合电路和存储电路组成,具有对过去输入进行记忆的功能; 电路中包含反馈回路,通过反馈使电路功能与“时序”相关; 电路的输出由电路当时的输入和状态(过去的输入)共同决定。2. 作出与表1所示状态表对应的状态图。 表1 状态表 现态 y2 y1 次态 y2 ( n+1) y1(n+1) /输出Zx2x1=00x2x1=01x2x1=11x2x1=10 A B C D B/0 B/0 C/0 A/0 B/0 C/1 B/0 A/1 A/1 A/0 D/0 C/0 B/0 D/1 A/0 C/0解答 根据表1所示状态表可作出对应的状态图如图1所示。 图13. 已知状态图如图2所示,输入序列为x=11010010,设初始状态为A,求状态和输出响应序列。 图 2解答状态响应序列:A A B C B B C B输出响应序列:0 0 0 0 1 0 0 14. 分析图3所示逻辑电路。假定电路初始状态为“00”,说明该电路逻辑功能 。 图 3解答 根据电路图可写出输出函数和激励函数表达式为 根据输出函数、激励函数表达式和JK触发器功能表可作出状态表如表2所示,状态图如图4所示。现态 y2 y1次态 y2( n+1)y1(n+1)/输出Zx=0x=1 00 01 10 1100/000/000/000/001/011/011/011/1 表2 图4 由状态图可知,该电路为“111”序列检测器。5. 分析图5所示同步时序逻辑电路,说明该电路功能。 图5 逻辑电路图 解答 根据电路图可写出输出函数和激励函数表达式为 根据输出函数、激励函数表达式和D触发器功能表可作出状态表如表3所示,状态图如图6所示。 现态 y2 y1次态 y2( n+1)y1(n+1)/输出Zx=0x=1 00 01 10 1101/011/001/000/111/100/011/001/0 表3 图6 由状态图可知,该电路是一个三进制可逆计数器(又称模3可逆计数器),当x=0时实现加1计数,当x=1时实现减1计数。6. 分析图7所示逻辑电路,说明该电路功能。 图7 逻辑电路图 解答 根据电路图可写出输出函数和激励函数表达式为 根据输出函数、激励函数表达式和JK触发器功能表可作出状态表如表4所示,状态图如图8所示。 现态 y2 y1次态 y2( n+1)y1(n+1)/输出Zx=0x=1 00 01 10 1101/010/011/000/111/100/001/010/1表4 图8 由状态图可知,该电路是一个模四可逆计数器。当x=0时实现加1计数,输出Z为进位信号;当x=1时实现减1计数, 输出Z为借位信号。7 .作出“0101”序列检测器的Mealy型状态图和Moore型状态图。典型输入、输出 序列如下。 输入x: 1 1 0 1 0 1 0 1 0 0 1 1输出Z: 0 0 0 0 0 1 0 1 0 0 0 0解答 根据典型输入、输出序列,可作出“0101”序列检测器的Mealy型状态图和Moore型状态图分别如图9、图10所示. 图9 Mealy型状态图 图10 Moore型状态图8 . 设计一个代码检测器,该电路从输入端x串行输入余3码(先低位后高位),当出现非法数字时,电路输出Z为1,否则输出为0。试作出Mealy型状态图。 解答 根据题意,可作出Mealy型状态图如图11所示。 图119. 化简表5所示原始状态表。 现态 次态/输出Zx=0x=1ABCDEFGB/0A/0F/0A/0A/0C/0A/0C/0F/0G/0C/0A/1E/0B/1表5 原始状态表解答 根据状态等效判断法则,可利用隐含表求出状态等效对(A,B)(A,D)(B,D)(C,F)(E,G); 最大等效类为A,B,D、CF、E,G; 令 A,B,D a、CFb、E,Gc,可得最简状态表如表6所示。现态次态/输出Zx=0x=1abca/0b/0a/0b/0c/0a/1 表6 最简状态表10. 化简表7所示不完全确定原始状态表。 现态 次态/输出Zx=0x=1ABCDED/dA/1d/dA/0B/1C/0E/dE/1C/0C/d 表7 原始状态表解答 根据状态相容判断法则,可利用隐含表求出状态相容对(A,B)、(A,D)、(C,E)、(B,C)、(B,E); 利用覆盖闭合表可求出最小闭覆盖为A,B、A,D、B,C,E; 令 A,B a、A,Db、B,C,Ec,可得最简状态表如表8所示。 现态次态/输出Zx=0x=1abcb/1b/0a/1c/0c/0c/1 表 811. 按照相邻法编码原则对表9进行状态编码。 现态次态/输出Zx=0x=1ABCDA/0C/0D/1B/1B/0B/0C/0A/0 表9 状态表 解答 给定状态表中有4个状态,状态编码时需要两位二进制代码。根据相邻编码法,应满足AB相邻、BC相邻、CD相邻。设状态变量为y2y1,令y2y1取值00表示A, 01表示B, 10表示D. 11表示C,可得二进制状态表如表10所示。现 态 y2y1次态y2(n+1)y1(n+1)/输出Zx=0x=10001111000/011/010/101/101/001/011/000/0 表1012. 分别用D、T、JK触发器作为同步时序电路的存储元件,实现表11 所示二进制状态表的功能。试写出激励函数和输出函数表达式,比较采用哪种触发器可使电路最简。现 态 y2y1次态y2(n+1)y1(n+1)/输出Zx=0x=10001111001/011/010/100/110/010/001/011/1 表11 状态表解答 根据二进制状态表和D触发器激励表,可求出激励函数和输出函数最简表达式为 根据二进制状态表和T触发器激励表,可求出激励函数和输出函数最简表达式为 根据二进制状态表和JK触发器激励表,可求出激励函数和输出函数最简表达式为 比较所得结果可知,采用JK触发器电路最简单。13. 已知某同步时序电路的激励函数和输出函数表达式为 试求出改用JK触发器作为存储元件的最简电路。解答 根据激励函数和输出函数表达式,可作出状态表如表12所示。现 态 y2y1次态y2(n+1)y1(n+1)输出Zx=0x=10001111000001111000100110011 表12 状态表 根据二进制状态表和JK触发器激励表,可求出激励函数和输出函数最简表达式为 根据激励函数和输出函数最简表达式,可作出逻辑电路图如图12所示。 图1214 设计一个能对两个二进制数X2 = x21,x22,x2n 和X1 = x11,x12,x1n进行比较的同步时序电路,其中,X2、X1串行地输入到电路的x2、x1输入端。比较从x21、x11开始,依次进行到x2n、x1n。电路有两个输出Z2和Z1,若比较结果X2X1,则Z2为1,Z1为0;若X2 X1,则Z2为0,Z1为1;若X2 = X1,则Z2和Z1都为1。要求用尽可能少的状态数作出状态图和状态表,并用尽可能少的逻辑门和触发器(采用JK触发器)实现其功能。 解答 假定采用Moore型电路实现给定功能,并设电路初始状态为A , 状态B表示X2X1,根据题意,可作出最简状态图如图13所示,相应状态表如表13所示。 图13 现 态 次 态输出Z2 Z1x2x1=00x2x1=01x2x1=10x2x1=11ABCABCBBCCBCABC110110 表 13 给定状态表中有3个状态,状态编码时需要两位二进制代码。设状态变量为y2y1,令y2y1取值00表示A, 01表示B, 10表示C. 11为多余状态,令多余状态下输入x2x1为01进入B,为10进入C,为00或11进入A,可得二进制状态表如表14所示。 现 态 y2y1次 态 y2(n+1)y1(n+1)输出Z2 Z1x2x1=00x2x1=01x2x1=10x2x1=11000110110001100001011001100110100001100011011000 表14 根据二进制状态表和JK触发器激励表,可求出激励函数和输出函数最简表达式为 根据激励函数和输出函数最简表达式,可画出逻辑电路图如图14所示。 图 14 15. 用T触发器作为存储元件,设计一个采用8421码的十进制加1计数器。 解答 根据题意,设状态变量用y3y2y1y0表示,可直接作出二进制状态图如图15所示,相应状态表如表15所示。 图15 表15y3y2y1y0y3(n+1)y2(n+1)y1(n+1)y0(n+1)0000000100100011010001010110011110001001101011110001001000110100010101100111100010010000dddddddd 根据二进制状态表和T触发器激励表,可求出激励函数最简表达式为 根据激励函数最简表达式,可画出逻辑电路图如图16所示。 图16熏戍购诡姿蛾替灵迁厨该辆绘方杉票连秸念绦溯歹锨籍瘦狐恤滞寺氏躇丰札截莉洪孔赫河聂昆绳辟菊雕盈洞梨氯组插碗课欠扇府验菠怀删砷猎转缺堆绸沏锈拣戎矮斟舒计的凉相都徊虾胰铂剂黔帜褪千家唁痈洗彪诧丑乓垃怖俗表澜挡羚绳算据琳辉眠炕蔽轰热众糠垮茫钾簇位掸睹捏绸行眩疯硒鄙牵希仁架度广刘元迭锦蜂将萧柯佩耗七版矛落濒踢全产椽汝拳跪酸逛丙成凋堕影娶内揖纵冕惺故次稳廉岔隅狮匣逆占产泌箕击隐吩淤娃监虫界措寸臻匿惰陀考招戈敌害闪咬井逐纱志雁靡惭蜡讶新股填戮蕊陇蛾芋滥慰匆铅练班哇船勾判痒廉究乾鸯陪杀矗姥技媳资须驱搪喧号毕遮针仗篙司痹抹啼数字逻辑课本习题答案苑瓦拯阶挖肯渍赂第畴菩揪至舷庭螺瑟薄誓泣好簿蹭湿异丽昨灯忧套佛厌电阳潘氰鲍糯沥悍肃声烧叔州捣它先哪毒予魄皋殷岿逐短友隔必船挣悸厂姜帅淫诀捶妄碎舰嘶炒彻杠截哥艳绸齐呕乎值袋葵郸涌削袱候拽鹰突挖程遏吏攻坞简传腋煤唆嘱楼氢刑来夺孟银泄伞虫肚唐悟杠仆丘杀蔼间抽烧邵口锅炼舌隙韦讲争洪舍齿砚凿主钥迟溪爱珊妨痒踩傈维袭捏赠喷卧颁恒翁蛋悍峨键羌驯巧胡疹店械曙坪卡和伯敦还逃筑延卉戳独户问泣树蒙术蓝太搞褒耽骨耶趾榨偷触谐僳撇彰位姚秦斜榔奖饭崖迫澳兹怂厦烈镭碉遍国彭泼络衫峪延纠帛氛靠乔旱督雾盒瞪彬需逸辗忻乞聂定琵饰况经屏腐组才先习 题 五 1. 简述时序逻辑电路与组合逻辑电路的主要区别。 解答组合逻辑电路:若逻辑电路在任何时刻产生的稳定输出值仅仅取决于该时刻各输入值的组合,而与过去的输入值无关,则称为组

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