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文档简介

,第三届计算机系统能力培养大赛,赵金鑫、朱俊信、王芳、厉泉宏,指导教师：符意德、杨宜远,南京理工大学2队,1.CPU设计,2.片上SoC结构,3.tlb设计,4.展示,目 录/contents,CPU设计,五级流水线结构,取指 生成目标地址 访问指令cache取出指令,译码 指令译码，读寄存器堆 生成跳转指令的目标地址,执行 根据指令操作类型进行相应的运算处理,访存 load/store指令访问数据cache,写回 根据写寄存器使能和地址进行 写寄存器操作,五级流水线结构,冲突处理,采用定向技术，进行数据转发 避免流水线的停顿,设置了分离的指令cache和数据cache,将判断是否分支转移及计算分支目标地址 两项工作提前到译码阶段完成 设置延迟槽,片上SoC结构,片上SoC整体结构,AXI 仲裁器,cache 设计,指令、数据预取，减小延迟的影响 猝发类型： burst wrap,哈佛结构：分离的指令cache、数据cache 使用Distribute Memory、Block Memory IP核,LRU替换策略、写回法 异步读、写,指令cache,2路组相联/256个块/块大小16*4B/总容量32KB 按字寻址,指令cache状态机,与CPU进行交流的主状态机,与AXI进行沟通的从状态机,数据cache,4路组相联/128个块/块大小16*4B/总容量32KB 按字寻址、设置了storebuffer、LRU替换策略、写回法,数据cache 状态机,数据cache 状态机,T L B设计,T L B结构,映射方式,访问周期,大小,模块位置,全相联模式,当前周期立刻返回,32项，奇偶页,iCache模块与pc之间，dChache与mem之间,T L B
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