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文档简介

异步计数器的应用一实验目的:1 实现0-9十进制数计数(使用74LS90,74LS47芯片);2 实现六进制数与三进制计数(使用74LS90,74LS47芯片,异步置零);3 实现0 2 4 6 8 1 3 5 7 9 的计数。二实验原理:1 要使数字显示译码器显示0-9的计数,必须在输入端接入74LS47译码器的输出,而该译码器需要在输入端引入8421BCD码;这样以来,需要用74LS90输出8421BCD码,可通过以下过程实现:时钟信号 CP1(输入) Q0(输出) CP2(输入) Q3Q2Q1Q0(输出8421BCD码,Q3为最高位)。电路图如图:2 列出74LS90的输出的8421BCD码与数字显示译码器译码器显示数字之间的关系: Q3Q2Q1Q0显示00000 000110010200113010040101501100(6) 从这张表格我们可以看到:当输出为0110时,输出应该自动清零;同时我们发现,该时刻Q2 Q1同时为一,之前的其它组合并没有这个特点;而且74LS90有两个清零端RV1和RV2,当同时为一是,便自动清零。于是我们只需要将Q2 Q1反馈到RV1 RV2,同时74LS4 D端接地,便能实现六进制数计数。电路图如图二:图表 1同理,三进制计数Q3Q2Q1Q1显示00000 000110010200110(3)即将Q1 Q0分别接到置零端,其余电路不变。3 列出74LS90的输入与数字显示译码器译码器显示数字之间的关系和5421BCD码:Q3Q2Q1Q0显示00000001020100401106100080001100113010150111710019Q0Q3Q2Q10000000100100011010110001001101010111100 观察以上两张表:将右表的Q0列移动至最后一列,便得到左表,由此我们可以用74LS90产生5421BCD码,然后将最高位接入74LS47的最低位A端,其余依次由高到低接入D C B。5421BCD码的产生方法为:时钟信号 CP2(输入) Q3(输出) CP1(输入) Q0Q3Q2Q1(输出5421BCD码,Q0为最高位)。电路图如下图:图表 2三实验内容:1 本实验输入CP脉冲接入Vpp=5V,f=3Hz,的方波。2 按照图一连接实验逻辑电路,实现十进制,然后观察实验结果,与实验要求对比。3 按照图二连接实验逻辑电路,实现六进制与三进制,然后观察实验结果,与实验要求对比。4 按照图三连接实验逻辑电路,然后观察实验结果,与实验要求对比。四实验总结:1 逻辑电路的设计过程设分灵活,通过列真

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