2010年下半年网络学院数字逻辑电路作业2.doc_第1页
2010年下半年网络学院数字逻辑电路作业2.doc_第2页
2010年下半年网络学院数字逻辑电路作业2.doc_第3页
全文预览已结束

下载本文档

版权说明：本文档由用户提供并上传，收益归属内容提供方，若内容存在侵权，请进行举报或认领

文档简介

2010年下半年网络学院数字逻辑电路 作业2一 填空题：1. 具有直接复位端和置位端的触发器，当触发器处于受CP脉冲控制的情况下工作时，这两端所加的信号为_。2. 基本RS触发器使用时不允许同时为_，即必须满足_的条件，这个条件也称为基本RS触发器输入信号的约束条件。3. 按逻辑功能来划分，触发器可分为RS触发器，JK触发器，D触发器和T触发器等四种类型。4. 每个触发器可记录1位二进制码，因为它有1个稳定态。5. 三态门有三种输出状态低、高和高阻，分别代表三种不同的逻辑值。6. 欲使JK触发器按工作，则J.K触发器输入端J=K=1，或J=_ ，K=_1_。7. 构造一个模10同步加1计数器，至少需要4个触发器。8. 时序逻辑电路按其状态改变是否受统一定时信号控制，可将其分为同步和异步两种类型。9. 根据计数过程中数字增减规律的不同，计数器可以分为加法计数器、_减计数器和逆计数器。10. 一个五位二进制加法器，由00000状态开始，向经过35个输入脉冲后，此计数器的状态为00011。11. 一个存储容量为1K8的存储器，能存8K位二进制数。12. 设一片RAM芯片的容量为10244，扩展为40968，求计算机片数6。13. 将一个包含有16384个基本存储单元的存储电路设计成8位为一个字节的ROM，该ROM有2048个地址，有8个数据读出线。14. 一个同步时序逻辑电路可用_、_和_三组函数表达式描述。15. 某存储芯片的容量为64K16，则其地址线和数据线分别为16条和16条。二 下图所示JK触发器电路上，加入周期性的时钟脉冲，设Q的初始状态为0，试画出各触发器Q端的波形。 1J K J K CP CP第一个，为计数器，按照计数器的波形来画。 第二个，一直为0三 在图示电路中，设原态，经过3个CP脉冲作用后，的状态是什么？并画出三个脉冲作用后的波形图。T Q 1 T Q 2 CPQ1Q2为11四. 根据下图所示的电路和波形，画出Q端波形。D A CPB CP A B Q五. 分析下图所示电路的功能。 F CP 100110111011001000 六. 时序逻辑电路如图：J Q F1K J Q F2K J Q F3K 1 “1” “1” CP1）写出驱动方程2）写出状态方程3）说明为同步时序电路还是异步时序电路4）画出状态转换图驱动方程：F1: J1 = ，K1 = 1； F2: J2 = 1，K2 = 1； F3: J3 = ，K3 = 1； 状态方
人人文库> 全部分类> 教育资料 > 课件下载

温馨提示

  • 1. 本站所有资源如无特殊说明，都需要本地电脑安装OFFICE2007和PDF阅读器。图纸软件为CAD,CAXA,PROE,UG,SolidWorks等.压缩文件请下载最新的WinRAR软件解压。
  • 2. 本站的文档不包含任何第三方提供的附件图纸等，如果需要附件，请联系上传者。文件的所有权益归上传用户所有。
  • 3. 本站RAR压缩包中若带图纸，网页内容里面会有图纸预览，若没有图纸预览就没有图纸。
  • 4. 未经权益所有人同意不得将文件中的内容挪作商业或盈利用途。
  • 5. 人人文库网仅提供信息存储空间，仅对用户上传内容的表现方式做保护处理，对用户上传分享的文档内容本身不做任何修改或编辑，并不能对任何下载内容负责。
  • 6. 下载文件中如有侵权或不适当内容，请与我们联系，我们立即纠正。
  • 7. 本站不保证下载资源的准确性、安全性和完整性, 同时也不承担用户因使用这些下载资源对自己和他人造成任何形式的伤害或损失。

最新文档

评论

0/150

提交评论