《双极等特殊工艺》PPT课件.ppt

集成电路设计基础 2020 3 26 集成电路设计基础 2 上次课内容 第3章集成电路工艺简介3 1引言3 2外延生长工艺3 3掩模的制版工艺3 4光刻工艺3 5掺杂工艺3 6绝缘层形成工艺3 7金属层形成工艺 2020 3 26 集成电路设计基础 3 本次课内容 第4章集成电路特定工艺4 1引言4 2双极型集成电路的基本制造工艺4 3MESFET工艺与HEMT工艺4 4CMOS集成电路的基本制造工艺4 5BiCMOS集成电路的基本制造工艺 2020 3 26 集成电路设计基础 4 所谓特定工艺 常常是指以一种材料为衬底 一种或几种类型的晶体管为主要的有源器件 辅以一定类型的无源器件 以特定的简单电路为基本单元 形成应用于一个或多个领域中各种电路和系统的工艺 4 1引言 2020 3 26 集成电路设计基础 5 特定工艺 这些特定工艺包括 硅基的双极型工艺 CMOS BiCMOS 锗硅HBT工艺和BiCMOS工艺 SOI材料的CMOS工艺 GaAs基 InP基的MESFET工艺 HEMT工艺和HBT工艺等 目前应用最广泛的特定工艺是CMOS工艺 在CMOS工艺中 又可细分为DRAM工艺 逻辑工艺 模拟数字混合集成工艺 RFIC工艺等 2020 3 26 集成电路设计基础 6 4 2双极型集成电路的基本制造工艺 在双极型集成电路的基本制造工艺中 要不断地进行光刻 扩散 氧化的工作 典型的PN结隔离的掺金TTL电路工艺流程图如下图所示 2020 3 26 集成电路设计基础 7 典型PN结隔离掺金TTL电路工艺流程图 2020 3 26 集成电路设计基础 8 双极型集成电路基本制造工艺步骤 1 衬底选择对于典型的PN结隔离双极集成电路 衬底一般选用P型硅 芯片剖面如图 2020 3 26 集成电路设计基础 9 双极型集成电路基本制造工艺步骤 2 第一次光刻 N 隐埋层扩散孔光刻一般来讲 由于双极型集成电路中各元器件均从上表面实现互连 所以为了减少寄生的集电极串联电阻效应 在制作元器件的外延层和衬底之间需要作N 隐埋层 2020 3 26 集成电路设计基础 10 第一次光刻 N 隐埋层扩散孔光刻 从上表面引出第一次光刻的掩模版图形及隐埋层扩散后的芯片剖面见图 2020 3 26 集成电路设计基础 11 双极型集成电路基本制造工艺步骤 3 外延层淀积外延层淀积时应该考虑的设计参数主要有 外延层电阻率 epi和外延层厚度Tepi 外延层淀积后的芯片剖面如图 2020 3 26 集成电路设计基础 12 双极型集成电路基本制造工艺步骤 4 第二次光刻 P 隔离扩散孔光刻隔离扩散的目的是在硅衬底上形成许多孤立的外延层岛 以实现各元件间的电隔离 目前最常用的隔离方法是反偏PN结隔离 一般P型衬底接最负电位 以使隔离结处于反偏 达到各岛间电隔离的目的 2020 3 26 集成电路设计基础 13 第二次光刻 P 隔离扩散孔光刻 隔离扩散孔的掩模版图形及隔离扩散后的芯片剖面图如图所示 2020 3 26 集成电路设计基础 14 双极型集成电路的基本制造工艺步骤 5 第三次光刻 P型基区扩散孔光刻基区扩散孔的掩模版图形及基区扩散后的芯片剖面图如图所示 2020 3 26 集成电路设计基础 15 双极型集成电路的基本制造工艺步骤 6 第四次光刻 N 发射区扩散孔光刻此次光刻还包括集电极 N型电阻的接触孔和外延层的反偏孔 2020 3 26 集成电路设计基础 16 第四次光刻 N 发射区扩散孔光刻 N 发射区扩散孔的掩模图形及N 发射区扩散后的芯片剖面图如图所示 2020 3 26 集成电路设计基础 17 双极型集成电路的基本制造工艺步骤 7 第五次光刻 引线接触孔光刻此次光刻的掩模版图形如图所示 2020 3 26 集成电路设计基础 18 双极型集成电路的基本制造工艺步骤 8 第六次光刻 金属化内连线光刻反刻铝形成金属化内连线后的芯片复合图及剖面图如图 2020 3 26 集成电路设计基础 19 4 3MESFET工艺与HEMT工艺 MESFET是第一代GaAs晶体管类型和工艺标识 是GaAs单片集成电路技术的基础 现在是GaAsVLSI的主导工艺 HEMT工艺是最先进的GaAs集成电路工艺 MESFET和HEMT两者的工作原理和工艺制造基础基本相同 2020 3 26 集成电路设计基础 20 MESFET工艺 下图将示出GaAsMESFET的基本结构 在半绝缘 Semi isolating s i GaAs衬底上的N型GaAs薄层为有源层 这一层可以采用液相外延 LPE 汽相外延 VPE 或分子束外延 MBE 三种外延方法沉积形成 也可以通过离子注入形成 2020 3 26 集成电路设计基础 21 MESFET工艺 2020 3 26 集成电路设计基础 22 MESFET工艺 1 有源层上面两侧的金属层通常是金锗合金 通过沉积形成 与有源层形成源极和漏极的欧姆接触 这两个接触区之间的区域定义出有源器件 即MESFET的电流沟道 MESFET通常具有对称的源漏结构 沟道中间区域上的金属层通常是金或合金 与有源层形成栅极的肖特基接触 2020 3 26 集成电路设计基础 23 MESFET工艺 2 由于肖特基势垒的耗尽区延伸进入有源层 使得沟道的厚度变薄 根据零偏压情况下沟道夹断的状况 可形成两种类型的MESFET 增强型和耗尽型 对于增强型MESFET 由于内在电势形成的耗尽区延伸到有源区的下边界 沟道在零偏压情况下是断开的 而耗尽型MESFET的耗尽区只延伸到有源区的某一深度 沟道为在零偏压情况下是开启的 2020 3 26 集成电路设计基础 24 MESFET工艺 3 在栅极加电压 内部的电势就会被增强或减弱 从而使沟道的深度和流通的电流得到控制 作为控制端的栅极对MESFET的性能起着重要的作用 由于控制主要作用于栅极下面的区域 所以 栅长即栅极金属层从源极到漏极方向上的尺寸 是MESFET技术的重要参数 常规情况下 栅长越短 器件速度越快 栅长为0 2 m的MESFET的截止频率约为50GHz 迄今为止 栅长已减小到100nm的尺度 2020 3 26 集成电路设计基础 25 MESFET工艺的效果 与HEMT工艺相比 相对简单和成熟的MESFET工艺使得光通信中高速低功率VLSI的实现成为可能 2020 3 26 集成电路设计基础 26 高电子迁移率晶体管 HEMT 在N型掺杂的GaAs层中 电子漂移速度主要受限于电子与施主的碰撞 要减小碰撞机会应减小掺杂浓度 最好没有掺杂 但同时希望在晶体结构中存在大量可高速迁移的电子 这就是高电子迁移率晶体管 HEMT 的原创思路 由于在晶体结构中存在大量可高速迁移电子 HEMT早期也被称为二维电子气场效应管 TEGFET 2020 3 26 集成电路设计基础 27 HEMT工艺 HEMT也属于FET的一种 它有与MESFET相似的结构 HEMT与MESFET之间的主要区别在于有源层 2020 3 26 集成电路设计基础 28 简单的HEMT的层结构 2020 3 26 集成电路设计基础 29 HEMT工艺 一种简单的HEMT有如上图所示的结构 在s i GaAs衬底上 一层薄的没有掺杂的GaAs层被一层薄 50 100nm N掺杂的AlGaAs层覆盖 然后在其上面 再形成肖特基栅极 源极与漏极欧姆接触 由于AlGaAs 1 74eV 和GaAs 1 43eV 的禁带不同 在AlGaAs层的电子将会进入没掺杂的GaAs层 并留在AlGaAs GaAs相结处附近 以致形成二维的电子气 2DEG 2020 3 26 集成电路设计基础 30 HEMT工艺 根据图结构HEMT栅极下AlGaAs层的厚度与掺杂浓度 其类型可为增强型或耗尽型 即自然断开和自然开启 对器件的测量表明 相对于掺杂的MESFET层 它有更强的电子移动能力 2020 3 26 集成电路设计基础 31 HEMT的性能和发展 由于HEMT的优秀性能 这类器件近十年有了广泛的发展 它在许多方面取得进展 如减小栅长 优化水平和垂直结构 改善2DEG限制结构及原料系统 HEMT传输的频率fT随栅长减小而增加 栅长越短则GaAs场效应管速度越快 至今先进HEMT工艺的栅长小于0 2 m 实验室水平小于0 1 m 但同时要考虑光刻分辨率以及减小栅长带来的栅极电阻增大的问题 栅长小于0 3 m可考虑采用蘑菇型即T型栅极 2020 3 26 集成电路设计基础 32 4 4CMOS集成电路的基本制造工艺 CMOS工艺技术是当代VLSI工艺的主流工艺技术 它是在PMOS与NMOS工艺基础上发展起来的 其特点是将NMOS器件与PMOS器件同时制作在同一硅衬底上 CMOS工艺技术一般可分为三类 即P阱CMOS工艺N阱CMOS工艺双阱CMOS工艺 2020 3 26 集成电路设计基础 33 P阱CMOS工艺 P阱CMOS工艺以N型单晶硅为衬底 在其上制作P阱 NMOS管做在P阱内 PMOS管做在N型衬底上 P阱工艺包括用离子注入或扩散的方法在N型衬底中掺进浓度足以中和N型衬底并使其呈P型特性的P型杂质 以保证P沟道器件的正常特性 2020 3 26 集成电路设计基础 34 P阱CMOS工艺 P阱杂质浓度的典型值要比N型衬底中的高5 10倍才能保证器件性能 然而P阱的过度掺杂会对N沟道晶体管产生有害的影响 如提高了背栅偏置的灵敏度 增加了源极和漏极对P阱的电容等 2020 3 26 集成电路设计基础 35 P阱CMOS工艺 电连接时 P阱接最负电位 N衬底接最正电位 通过反向偏置的PN结实现PMOS器件和NMOS器件之间的相互隔离 P阱CMOS芯片剖面示意图见下图 2020 3 26 集成电路设计基础 36 N阱CMOS工艺 N阱CMOS正好和P阱CMOS工艺相反 它是在P型衬底上形成N阱 因为N沟道器件是在P型衬底上制成的 这种方法与标准的N沟道MOS NMOS 的工艺是兼容的 在这种情况下 N阱中和了P型衬底 P沟道晶体管会受到过渡掺杂的影响 2020 3 26 集成电路设计基础 37 N阱CMOS工艺 早期的CMOS工艺的N阱工艺和P阱工艺两者并存发展 但由于N阱CMOS中NMOS管直接在P型硅衬底上制作 有利于发挥NMOS器件高速的特点 因此成为常用工艺 2020 3 26 集成电路设计基础 38 N阱CMOS芯片剖面示意图 N阱CMOS芯片剖面示意图见下图 2020 3 26 集成电路设计基础 39 双阱CMOS工艺 随着工艺的不断进步 集成电路的线条尺寸不断缩小 传统的单阱工艺有时已不满足要求 双阱工艺应运而生 2020 3 26 集成电路设计基础 40 双阱CMOS工艺 通常双阱CMOS工艺采用的原始材料是在N 或P 衬底上外延一层轻掺杂的外延层 然后用离子注入的方法同时制作N阱和P阱 2020 3 26 集成电路设计基础 41 双阱CMOS工艺 使用双阱工艺不但可以提高器件密度 还可以有效的控制寄生晶体管的影响 抑制闩锁现象 2020 3 26 集成电路设计基础 42 双阱CMOS工艺主要步骤 双阱CMOS工艺主要步骤如下 1 衬底准备 衬底氧化 生长Si3N4 2 光刻P阱 形成阱版 在P阱区腐蚀Si3N4 P阱注入 3 去光刻胶 P阱扩散并生长SiO2 4 腐蚀Si3N4 N阱注入并扩散 5 有源区衬底氧化 生长Si3N4 有源区光刻和腐蚀 形成有源区版 6 N管场注入光刻 N管场注入 2020 3 26 集成电路设计基础 43 双阱CMOS工艺主要步骤 7 场区氧化 有源区Si3N4和SiO2腐蚀 栅氧化 沟道掺杂 阈值电压调节注入 8 多晶硅淀积 掺杂 光刻和腐蚀 形成多晶硅版 9 NMOS管光刻和注入硼 形成N 版 10 PMOS管光刻和注入磷 形成P 版 11 硅片表面生长SiO2薄膜 12 接触孔光刻 接触孔腐蚀 13 淀积铝 反刻铝 形成铝连线 2020 3 26 集成电路设计基础 44 MOS工艺的自对准结构 自对准是一种在圆晶片上用单个掩模形成不同区域的多层结构的技术 它消除了用多片掩模所引起的对准误差 在电路尺寸缩小时 这种有力的方法用得越来越多 有许多应用这种技术的例子 例子之一是在多晶硅栅MOS工艺中 利用多晶硅栅极对栅氧化层的掩蔽作用 可以实现自对准的源极和漏极的离子注入 如图所示 2020 3 26 集成电路设计基础 45 自对准工艺示意图 2020 3 26 集成电路设计基础 46 自对准工艺 上图中可见形成了图形的多晶硅条用作离子注入工序中的掩模 用自己的 身体 挡住离子向栅极下结构 氧化层和半导体 的注入 同时使离子对半导体的注入正好发生在它的两侧 从而实现了自对准 而且原来呈半绝缘的多晶硅本身在大量注入后变成低电阻率的导电体 可见多晶硅的应用实现 一箭三雕 之功效 2020 3 26 集成电路设计基础 47 4 5BiCMOS集成电路的基本制造工艺 BiCMOS工艺技术是将双极与CMOS器件制作在同一芯片上 这样就结合了双极器件的高跨导 强驱动和CMOS器件高集成度 低功耗的优点 使它们互相取长补短 发挥各自优点 从而实现高速 高集成度 高性能的超大规模集成电路 2020 3 26 集成电路设计基础 48 BiCMOS工艺分类 BiCMOS工艺技术大致可以分为两类 分别是以CMOS工艺为基础的BiCMOS工艺和以双极工艺为基础的BiCMOS工艺 一般来说 以CMOS工艺为基础的BiCMOS工艺对保证CMOS器件的性能比较有利 同样以双极工艺为基础的BiCMOS工艺对提高保证双极器件的性能有利 2020 3 26 集成电路设计基础 49 以P阱CMOS工艺为基础的BiCMOS工艺 以P阱CMOS工艺为基础是指在标准的CMOS工艺流程中直接构造双极晶体管 或者通过添加少量的工艺步骤实现所需的双极晶体管结构 下图为通过标准P阱CMOS工艺实现的NPN晶体管的剖面结构示意图 2020 3 26 集成电路设计基础 50 标准P阱CMOS工艺实现的NPN晶体管的剖面结构示意图 2020 3 26 集成电路设计基础 51 标准P阱CMOS工艺结构特点 这种结构的缺点是 1 由于NPN晶体管的基区在P阱中 所以基区的厚度太大 使得电流增益变小 2 集电极的串联电阻很大 影响器件性能 3 NPN管和PMOS管共衬底 使得NPN管只能接固定电位 从而限制了NPN管的使用 2020 3 26 集成电路设计基础 52 以N阱CMOS工艺为基础的BiCMOS工艺 N阱CMOS NPN体硅衬底结构剖面图 2020 3 26 集成电路设计基础 53 N阱CMOS工艺为基础的BiCMOS工艺 N阱CMOS工艺为基础的BiCMOS工艺与以P阱CMOS工艺为基础的BiCMOS工艺相比 优点包括 1 工艺中添加了基区掺杂的工艺步骤 这样就形成了较薄的基区 提高了NPN晶体管的性能 2020 3 26 集成电路设计基础 54 N阱CMOS工艺为基础的BiCMOS工艺 2 制作NPN管的N阱将NPN管与衬底自然隔开 这样就使得NPN晶体管的各极均可以根据需要进行电路连接 增加了NPN晶体管应用的灵活性 2020 3 26 集成电路设计基础 55 N阱CMOS工艺为基础的BiCMOS工艺 它的缺点是 NPN管的集电极串联电阻还是太大 影响双极器件的驱动能