八位加法器设计试验报告

1、精品文档实验四：8位加法器设计实验1.实验目的：熟悉利用quartus原理图输入方法设计简单组 合电路，掌握层次化设计方法。2.实验原理：一个八位加法器可以由八个全加器构成，加法 器间的进位可以串行方式实现， 即将低位加法器的进位输出cout与相邻的高位加法器的最低进位输入信号cin相接。3.实验任务：完成半加器，全加器，八位加法器设计，使用 例化语句， 并将其设计成一个原件符号入库， 做好程序设计， 编译，程序仿真。1)编译成功的半加器程序：module h_adder(a,b,so,co);input a,b;output so,co;assign so=aAb;assign co=a&a

2、mp;b;endmodule2)编译成功的全加器程序：module f_adder(ain,bin,cin,cout,sum);output cout,sum;input ain,bin,cin;wire net1,net2,net3;h_adder u1(ain,bin,net1,net2);h_adder u2(.a(net1),.so(sum),.b(cin),.co(net3);1欢。迎下载精品文档or u3(cout,net2,net3);endmodule3)编译成功的八位加法器程序：module f_adder8(ain,bin,cin,cout,sum);output 7:0s

3、um; output7:0ain,bin;input cin;wire cout0, cout1, cout2 ,cout3, cout4,cout5,cout6; f_adderu0(.ain(ain0),.bin(bin0),.cin(cin),.sum(sum0),.cout(cout0);f_adderu1(.ain(ain1),.bin(bin1),.cin(cout0),.sum(sum1),.cout(cout1);f_adderu2(.ain(ain2),.bin(bin2),.cin(cout1),.sum(sum2),.cout(cout2);f_adderu3(.ain(

4、ain3),.bin(bin3),.cin(cout2),.sum(sum3),.cout(cout3);f_adderu4(.ain(ain4),.bin(bin4),.cin(cout3),.sum(sum4cout;input2欢。迎下载精品文档),.cout(cout4);f_adderu5(.ain(ain5),.bin(bin5),.cin(cout4),.sum(sum5),.cout(cout5);f_adderu6(.ain(ain6),.bin(bin6),.cin(cout5),.sum(sum6),.cout(cout6);f_adderu7(.ain(ain7),.b

5、in(bin7),.cin(cout6),.sum(sum7),.cout(cout);endmodule4)八位加法器仿真程序：module f_adder8_vlg_tst();/ constants/ general purpose registers/reg eachvec;/ test vector input registersreg 7:0 ain;reg 7:0 bin;reg cin;/ wires wire cout;3欢。迎下载精品文档wire 7:0 sum;/ assign statements (if any)f_adder8 i1 (/ port map - co

6、nnection between master ports signals/registers.ain(ain),.bin(bin),.cin(cin),.cout(cout),.sum(sum);initialbeginain=10;bin=11;cin=0;#100 ain=10;bin=10;cin=0;#100 ain=10;bin=10;cin=1;#100 ain=12;bin=18;cin=0;#100 ain=12;bin=18;cin=1;#100 $stop;end4欢。迎下载andendmodule5）八位加法器仿真图:File Edit View Compile Sim

7、ulate Add Wave Tcol Layout Window HelpH厨飞电（B1IU3 娅臣|Mj ColumnLayout |Defaultjrj|T6函向创FT回鱼I亟1働；】Transcript=# Simulation Breakpoint: Break in Module f_adderS_vlaz at D:/quaniia5i/f_adderS/simulatiot# MACRO * / f_adderE_nin_insim_r t l_verLog * do PAUSED耳匸line 196）元件原理图及元件入库:5欢迎下载精品文档M ModelSim ALTERA

8、STARTER EDITION lD.Od*| InstanceDesign unitDesign ur二hZ f_addefS_vlg_t5tf_addera_vl., Module+ 1 . iif_adderBModule1-J #INEAL#带f_addera_vl. ProcessMNamelvalueKindModeC3 * DJainOOOOL, Pack,.rizernabin00010. Pdc.jfan1Regis*,.JiTer naGOUtStflNet丁zcnaa *sumQOOU.NetIntern*1|上JdMLbraryjsim 1H勸aim - Default

9、 :：:二1函凶vsimjcapadty#CapacityObjects- ； 1函凶Wave - Default :；SlM（paued）精品文档半加器原理图J Quartus H 32-bit - 6ujnntu/h-odde- h.日ddejFile Edit: View Project Assignments Processing Tools Window Help xx v Sear(hv Type MessageInfo (293000: Quartus II Full Compilation was Buccessful, 0 errors, S warniS I System人

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13、2015/10/22 16:21SMSG如|_j h_adderfit summary2015/10/22 16:21SUMMARY文件h_adderrflow.rpt2015/10/22 16:21RPT文件_ h adderjdi2015/10/22 16:21JDI文件I haddermapt2015/10/22L6J20RPT文件h_adder.map.summary2015/10/22 16:20SUMMARY文件口h_adderpin2015/10/22 1&21PIN文件囲1 h_adder.qpf2015/10/22 16:17QPF文件_ h addecqsf2015

14、/10/22 16:20QSF文件.h_addersof2015/10/22 1&21SOF文件h adder.sta.rpt2015/10/22 16:21RPT文件h_addertaunrnnary2015/10/22 16i21SUMMARY文件h_adder.bsf修改日期2015/10/22 1&22BSF文件大1.92 KB剖潼日朗！2015/10/22122全加器原理图:7欢迎下载精品文档Quartus II 32-bit - D:,/yuan11tu/f_adder - f_addFile EditVi亡训Project Assignments Processi

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16、2 1&31BDF文件囲f adder,bsf2015/10/22 16:32ESF文件|_jf_adder.done类型:BSF文件1DONE文件,.f_adder.eda,rpt尢j、:2.12 KB1RPT文件,fadder.fitrpt修改日期：2015/10/22 16:321RPT文件-f_adder.fit.smsg2015/10/22 1&31SMSG文件,.f_adder.fit.su mm ary2015/10/22 16:31SUMMARY文件_ f_adder.flowrrpt2015/10/22 16:31RPT文件Ladderjdi2015/10/2

17、2 1631JDI文件,fadder.map.rpt2015/10/22 16:31RPT文件-f_adder.map.summairy2015/10/22 16:31SUMMARY文件0f_adder,pin2015/10/22 1&31PIN文件鬪fadder.qpf2015/10/22 16:27QPF文件,Ladder.qf2015/10/22 1631QSF文件f adder.sof11 -MT2015/10/22 16:31SOF文件f_adder.Eta.rpt2015/10/22 16:31RPT文件,.f_adder.sta.summary2015/10/22 1&31SUMMARYh_adder.asm.rpt2015/10/22 16:21RPT文件楼|h adderbdf2015/10/22 1&2DEDF文件屈h_addenbsf2015/10/2