基于FPGA的线阵CCD驱动时序及 模拟信号处理的设计

1、    基于FPGA的线阵CCD驱动时序及 模拟信号处理的设计摘要：实现了一种全集成可变带宽中频宽带低通滤波器，讨论分析了跨导放大器-电容(OTAC)连续时间型滤波器的结构、设计和具体实现，使用外部可编程电路对所设计滤波器带宽进行控制，并利用ADS软件进行电路设计和仿真验证。仿真结果表明，该滤波器带宽的可调范围为126 MHz，阻带抑制率大于35 dB，带内波纹小于05 dB，采用18 V电源，TSMC 018m CMOS工艺库仿真，功耗小于21 mW，频响曲线接近理想状态。关键词：Butte1 引言   电荷耦合器CCD具

2、有尺寸小、精度高、功耗低、寿命长、测量精度高等优点，在图像传感和非接触测量领域得到了广泛应用。由于CCD芯片的转换效率、信噪比等光电特性只有在合适的时序驱动下才能达到器件工艺设计所要求的最佳值，以及稳定的输出信号，因此驱动时序的设计是应用的关键问题之一。通用CCD驱动设计有4种实现方式：EPROM驱动法；IC驱动法；单片机驱动法以及可编程逻辑器件(PLD)驱动法。    基于FPGA设计的驱动电路是可再编程的，与传统的方法相比，其优点是集成度高、速度快、可靠性好。若要改变驱动电路的时序，增减某些功能，仅需要对器件重新编程即可，在不改变任何硬件的情况下，即可实现驱动

3、电路的更新换代。2 CD 1501D CCD工作参数及时序分析21 TCDl50lD CCD工作参数    所选器件是日本TOSHIBA公司的TCDl50lD CCD作为光电传感器，该芯片是高灵敏度、低噪声和宽动态范围的线阵CCD器件。主要参数如下：    光敏像元数：5000个 像元尺寸：7m×7m×7m    光谱响应范围：300l 000 nm灵敏度：104156V/Lxs    动态范同典型值：3 000 nm饱和曝光度典型值：0.23Lxs

4、60;   驱动时钟频率最大值：12 MHz    该器件正常工作的驱动脉冲主要有：复位时钟RS、移位脉冲1、2和转移脉冲SH。该器件具有5 000个有效像元，正常工作还需要76个虚设单元输出(dummy outputs)信号。由于该器件是两列并行传输，所以在一个周期内至少需要2538个1(或2)时钟脉冲才能完成一帧图像转移。22 驱动时序分析   各驱动时序之间正确的先后关系是保证CCD正常工作的前提。具体时序关系如图1所示。3 CCD输出信号的采集    CCD器件输出的原始信号中

5、除了有用的信号外，还夹杂着各种噪声和干扰，主要有光子噪声、散粒噪声、暗电流噪声、复位噪声以及输出噪声等，而影响最大的是复位噪声。通过理论及实验可知，相关双采样是消除复位噪声最有效的方法之一。其原理是利用复位噪声在同一像素周期内近似为常数，因此，只要把同一像素周期内的参考电平和信号电平进行两次采样，再进行相减，即可消除复位噪声。31 内部信号处理   与其他线阵CCD不同的是TCDl50lD内部包含有采样保持电路。由图1可知，OS经SH脉冲采样后，得到所有视频信号的包络，经CP箝位电平后输出一个大概为5 V左右的直流分量，两个波形再通过差分即可得到有用的视频信号。若要保证信号的不失真输出，则t12和t18需越小越好，必须满足时间最小值要求，即让采样脉冲SH和箝位脉冲CP对OS信号在很短时间内准确地对阴影部分信号电平和参考电平分别进行采样，然后两者差分。输出视频信号的示意图如图2所示，图2(a)中的阴影部分是有用的视频信号，白色部分是参考电平，图2(b)是相关双采样后CCD每个像元中视频信号包络的集合，是一个负极性的离散模拟信号，图2(c)是翻转之后的正极性信号。这个过