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文档简介

1、同步序向設計同步序向設計問題定義及狀態簡問題定義及狀態簡化程序：化程序：文字文字(verbal)敘述功敘述功能，能，初步狀態圖初步狀態圖、表。表。狀態化簡，求出狀態化簡，求出最最簡狀態圖表簡狀態圖表。對各狀態做對各狀態做二進編二進編碼碼。 正反器規劃正反器規劃(Flip-flop Programming)程序：程序： 選用選用暫存器、正反暫存器、正反器、器、ROM、MUX或其他或其他MSI元件元件。 導出激表、導出激表、激式激式。 求出求出激發電路激發電路。 製作製作組合式控制電組合式控制電路路。同步序向系統同步序向系統AABBABcp 時脈輸入JAKAKBJA輸入輸入 x輸出輸出 y 現在要

2、用JK正反器設計一個同步序向電路，其初步狀態圖初步狀態圖如所示。PSNS正反器正反器激發條激發條件件A由01 (PSNS), JA=1 KA=X (1或0): JK=1X01234567m Bx3 , 2 , 1 ,0m7mKABx7 ,6 , 5 ,4m2mJA AxxA5 ,4 , 1 ,0m7 , 2mKBx7 ,6 , 3 , 2m5 , 1mJB X X 為隨意條件由激式繪出控制電路BAKBxJBBxKABxJA D正反器之激發條件： D = Q(t+1)6 , 5 , 3 , 1x ,B,ADB6 , 5 ,4 , 2x ,B,ADAABxxBxADBBxABDAABcpAABBx

3、0 x1xxxxxx123ROM123輸出輸出位址線資料線n考慮初步之考慮初步之狀態圖，有狀態圖，有7 個狀態。個狀態。n欲做狀欲做狀態簡化態簡化n 對某一組輸入，任何兩個現狀態，如有對某一組輸入，任何兩個現狀態，如有1. 相同的輸出相同的輸出；且；且2. 使得電路使得電路有相同的次狀態有相同的次狀態， 則此二狀態為則此二狀態為等效等效 (equivalent)狀態。狀態。n 凡是二個狀態等效，則可移去其一，或凡是二個狀態等效，則可移去其一，或做合併做合併(merge)，而不會影響原有的輸入，而不會影響原有的輸入與輸出關係。與輸出關係。e,g等效等效g e, 移去狀態移去狀態g, g改成改成e

4、,又發現又發現d,f 等效等效f d, 移去移去f, 得到最簡化狀態表：得到最簡化狀態表：n 最後，簡最後，簡化狀態圖化狀態圖只有五個只有五個狀態。狀態。n計數器計數器(Counter)是一種序向電路，再是一種序向電路，再每一個計時脈波到達後，依照一定的每一個計時脈波到達後，依照一定的序列變化狀態。序列變化狀態。n計數器的計數器的狀態順序狀態順序為二進數碼所指定，為二進數碼所指定，以狀態圖或狀態遷移表敘述之。以狀態圖或狀態遷移表敘述之。n計數器有計數器有漣波漣波(Ripple)計數器，及計數器，及同步同步型型(Synchronous)計數器二種。計數器二種。7 , 3mTA27 , 5 , 3 , 1mTA11TA0n同步計數：所有正反器使用同同步計數：所有正反器使用同一個時脈一個時脈(cp)n任何

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