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文档简介
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2、实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块JTAG1 JTAG1 引脚序号引脚序号JTAGJTAG功能组功能组相关说明相关说明1TCK时钟2NC空脚3TMS模式控制4GND地5TDI数据输入6NC空脚7TDO数据输出8GND地9+5V电源10+5V电源基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于D
3、SP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬
4、件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块相相顺顺序序ABCD01010101102010131001基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块码码 位位备备 注注1-ON;2-ONCPU中断2给键盘接口1-ON;2-OFFCPU中断2给A/D转换单元1-OFF;2-ONCPU中断3给键盘接口1-OFF;2-OFFCPU中断2、3置高,
5、缺省设置基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块码码 位位备备 注注1OFF, A/D单元采样时钟为低频,缺省设置;ON, A/D单元采样时钟为高频2ON, J8为信号源1、2路的混频输出;OFF,断开混频输出,缺省设置基于DSP的数字信号处理实验指导教程引脚序号引脚序号JTAG功能组功能组相关说明相关说明1TMSJTAG模式控制2TRSTJTAG复位3TDIJTAG数据输入4GND地5电源+3.3V6NC空脚7TDOJTAG数据输出8GND地9TCLKJTAG时钟10GND地11TCLKJTAG时钟12GND地13EMU0仿真中断014EMU1仿真中断1基于DSP的数字信号处理实验指导教程3.2 系统硬件模块系统硬件模块状状态态备备 注注按按下下JTAG3连接到JTAG2弹弹起起JTAG3连接到JTAG1基于DSP的数字信号处理实验指导教程3.3 硬件仿真系统硬件仿真系统
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