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1、实验三实验三 寄存器堆与计数器寄存器堆与计数器 2019.4.112019春_计算机组成原理实验_CS-USTC 12019-3-28实验内容实验内容1. 寄存器堆（寄存器堆（Register File）ra0, rd0; ra1, rd1：2个异步读端口个异步读端口wa, wd, we：1个同步写端口个同步写端口2. 计数器（计数器（Counter）ce：计数使能，：计数使能，1: q=q+1pe：同步装数使能，：同步装数使能，1: q=drst：异步清零，：异步清零，1: q=02019春_计算机组成原理实验_CS-USTC 22019-3-28ra1ra0RFwdwarstrd1rd0m

2、nclkdCNTnnqrstclkwenpece实验内容实验内容3. 最大长度为最大长度为8的的FIFO循环队列：用寄存器堆和循环队列：用寄存器堆和适当逻辑实现适当逻辑实现2019春_计算机组成原理实验_CS-USTC 32019-3-28en_ininFIFOrstout44clkfullemptyen_outdisplay16- en_out, en_in：出：出/入队入队列使能，一次有效仅允许列使能，一次有效仅允许操作一项数据操作一项数据- out, in：出：出/入队列数据入队列数据- full, empty：队列空：队列空/满，满，空空/满时忽略出满时忽略出/入队操作入队操作- di

3、splay：8个数码管的控个数码管的控制信号，显示队列状态制信号，显示队列状态 .1. 2 32. 3复位复位数据数据1, 2,1, 2, 3 3依次入队依次入队列列数据数据1 1出队列出队列实验要求和检查实验要求和检查 完成完成1和和3的的逻辑设计、仿真和下载测试的的逻辑设计、仿真和下载测试 逻辑设计采用模块化设计 仿真3时忽略display 下载测试时，时钟采用板载100MHz时钟，其他输入由拨动开关和按钮开关设置，结果输出至LED指示灯或7段数码管 查看查看1和和2的电路性能和资源使用情况的电路性能和资源使用情况 检查仿真结果是否正确检查仿真结果是否正确 检查下载测试是否正确检查下载测试

4、是否正确 检查代码设计，代码是否独立完成检查代码设计，代码是否独立完成2019春_计算机组成原理实验_CS-USTC 42019-3-28实验报告实验报告 内容包括但不限于：逻辑设计（数据通路和状态内容包括但不限于：逻辑设计（数据通路和状态图）、核心代码、仿真图）、核心代码、仿真/下载结果、结果分析、实下载结果、结果分析、实验总结、意见验总结、意见/建议等，附设计和仿真代码建议等，附设计和仿真代码 实验检查后一周内提交实验报告实验检查后一周内提交实验报告 34/ 相应文件夹 文件名格式：Labn_学号_姓名.pdf （其中n为第几次实验，不满足该格式的视为未提交实验报告） 严禁抄袭，否则作零分处理严禁抄袭，否则作零分处理2019春_计算机组

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