组成n进制计数器

1、实验 74LS160组成n进制计数器一、实验内容1掌握集成计数器的功能测试及应用2用异步清零端设计6进制计数器，显示选用数码管完成。3用同步置零设计7进制计数器，显示选用数码管完成。二、演示电路74LS160十进制计数器连线图如图1所示。图1 74LS160十进制计数器连线图CLR：异步清零端CLK：时钟输入端（上升沿有效）A- D：数据输入端ENP，ENT：计数控制端LOAD：同步并行置入控制端RCO：进位输出端74160的功能表如表1所示。由表1可知，74160具有以下功能：     异步清零     当（CL

2、R）=0时，不管其他输入端的状态如何（包括时钟信号CP ），计数器输出将被直接置零，称为异步清零。     同步并行预置数在=1的条件下，当(LOAD)=0、且有时钟脉冲CP 的上升沿作用时，D0、D1、D2、D3 输入端的数据将分别被Q0Q3所接收。由于这个置数操作要与CP 上升沿同步，且D0、D1、D2、D3的数据同时置入计数器，所以称为同步并行置数。 保持    在=1的条件下,当ENT=ENP=0,即两个计数使能端中有0时,不管有无CP 脉冲作用，计数器都将保持原有状态不变(停止计数)。需要说明的是，当EN

3、P=0, ENT=1时，进位输出C也保持不变；而当ENT=0时，不管ENP状态如何，进位输出RCO=0。     计数    当=ENP=ENT=1时，74161处于计数状态,电路从0000状态开始，连续输入16个计数脉冲后，电路将从1111状态返回到0000状态，RCO端从高电平跳变至低电平。可以利用RCO端输出的高电平或下降沿作为进位输出信号。表1 74161的功能表输入输出CP P T D0 D1 D2 D3Q0 Q1 Q2 Q3× 0 × × × × 

4、15; × × 0 0 0 0 1 0 × × a b c da b c d× 1 1 0 1 × × × ×保持× 1 1 × 0 × × × ×保持(C=0) 1 1 1 1 × × × ×计数连上十进制加法计数器160，电路如图1所示，给2管脚加矩形波，看数码管显示结果，并记录显示结果。三、用160和与非门组成6进制加法计数器-用异步清零端设计74160从0000状态开始计数，当输入第6个CP 脉冲（

5、上升沿）时，输出Q3 Q2 Q1 Q00110，此时=0，反馈给端一个清零信号，立即使Q3 Q2 Q1 Q0返回0000状态，接着,端的清零信号也随之消失，74160重新从0000状态开始新的计数周期。反馈归零逻辑为代码中为1的Q相与非。电路如图2所示，给2管脚加矩形波，看数码管显示结果，并记录显示结果。图2 用异步清零端设计四、用160和与非门组成7进制加法计数器-用同步置零设计计数器从Q3Q2Q1Q0=0000开始计数，当第6个CP到达后，计到0110，此时=0。并不能立即清零，而是要等第7个脉冲上沿到来后，计数器被置成0000。不会用异步清零端那样出现0110过渡状态，这是与用异步清零端的差别。用同步清零端设计计数器如图3所示，如，则为七进制计数器。图3 同步清零端设计计数器五、实验报告1. 实验名称、内容和实验电路。2. 说明同步置0与异步清零的区别？ 3. 总结使用集成计数器的体会五、试用同步十进制计数器74LS160接成16进制计数器设计思路：