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文档简介

实验五 数据选择器和译码器数据选择器和译码器的功能。2.用数据选择器实现逻辑函数。3.用译码器实现逻辑函数。二、设计任务与要求设计一个表决电路。设A为主裁判，B,C.D为副裁判。只有在主裁判同意的前提下，三名副裁判中多数同意，比赛成绩才被承认，否则，比赛成绩不予承认。（1）要求用4选1数据选择器实现。（1为同意，0为不同意）（2）用一片3线-8线译码器和与非门实现。三、实验内容与步骤1.74LS153芯片（双4选1数据选择器）C3C2C1 C074153功能表1G2G12C2B1C31C11C22C31C02C02C1GNDVCC2YA91Y168G 选通Y 输出 1 2 3 4 5 6 7 8 16 15 14 13 12 11 10 9ABC使能输入 输出地Vcc数 据 输 出Y0 Y1 Y2 Y3 Y4 Y5 Y6G1=1 G2=0器时译码正常工作 G2=G2A+G2BG1G2A G2B

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