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文档简介

1、简易音乐播放器实验目的 1、学习VHDL与图形相结合的设计方法 2、学习利用数控分频器设计原理 3、学习乐曲演奏和按键使用的原理。 乐谱中从低音1到高音1之间每个音名的频率如表所示 实验原理 根据公式算出此次设计中应用的各音名对应的分频系数值及初始值如表所示：乐曲演奏电路结构方框图1.分频器电路模块 该演奏电路的最小节拍为1拍，将一拍的时长定为0.25s，则只需要再提供一个4Hz的时钟频率即可产生一拍的时长，该编码模块的作用为将12MHZ的时钟信号分频出4HZ的时钟信号，从而实现只用一个时钟信号控制电路。clkdddinst2. 音调发生器模块在此模块中设置了一个8位二进制计数器（计数最大值为

2、64），这个计数器的计数频率选为4Hz，即每一计数值的停留时间为0.25s，恰好为当全音符设为1s时，四四拍的4分音符的持续时间。clktoneindex3.0ydfsqinst3.音调编码器电路模块 该编码模块的作用为将输入的音符数据翻译为音乐产生模块的所需要的分频系数，index为音调发生模块输出的音符数据，经过翻译后将tone输出到数控分频模块为其提供分频系数的初始值，code为数码管显示的字符数，code1为高音阶指示信号，当code1为 2是说明输出为高音阶的音符。index3.0code3.0code13.0tone10.0ydbmqinst4.数控分频器模块 输入clk是12MH

3、z的时钟信号，输入tone代表着某个音符的分频初始值，输出spks则代表将输入clk先经过12次分频，再经过（预置数终值2048-tone）次分频，最终再进行二分频处理，而这个信号的频率就是我们需要演奏的音谱的频率，根据频率的不同，从而能通过喇叭听到不同的声音，实现音乐的播放。clktone10.0spksskfpqinst5.播放控制模块 输入rst代表整体复位端，输入d1自动演奏的音符，q为输出端，当rst=1时，输出q为零，达到了整体复位的功能；当rst=0演奏乐曲。顶层程序 利用元件例化把各个子模块组合起来，进行编译、下载，从而实现整体功能。它将音调发生器(ydfsq)模块、音调编码器(ydbmq)模块、分频器模块（dd）、播放控制(bmux)模块及数控分频器(skfpq)模块连接起来。总结 通过本次大作业，深刻体会了VHDL设计的优势，通过EDA工具和硬件描述语言使演奏电路很易实现。同时，这次设计使我对quartus的运用更加灵活，熟悉了对该软件从工程建立到程序下载执行各个步骤

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