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文档简介

一、实验目的1.了解全加器的实现方法。

2.掌握全加器的功能。3.掌握组合逻辑电路的设计与测试方法。

1二、实验所用器件和仪表

1.二输入四与非门74LS001块

2.二输入四与门74LS081块

3.二输入四或非门74LS021块

4.二输入四异非门74LS861块

5.4-2-3-2与或非门74LS642块

6.根据设计需要选配元器件2三、设计思路1.使用中、小规模集成电路来设计组合电路是最常见的逻辑电路。设计组合电路的一般步骤如图5.1所示。图5.1组合逻辑电路设计流程图3根据设计任务的要求建立输入、输出变量，并列出真值表。然后用逻辑代数或卡诺图化简法求出简化的逻辑表达式。并按实际选用逻辑门的类型修改逻辑表达式。根据简化后的逻辑表达式，画出逻辑图，用标准器件构成逻辑电路。最后，用实验来验证设计的正确性。

42、组合逻辑电路设计举例用“与非”门设计一个表决电路。当四个输入端中有三个或四个为“1”时，输出端才为“1”。设计步骤：（1）根据题意列出真值表如表5－1所示，再填入卡诺图表5.2中。

D0000000011111111A0000111100001111B0011001100110011C0101010101010101Z0000000100010111表5.15表5.2DABC000111100001111111101（2）由卡诺图得出逻辑表达式，并演化成“与非”的形式Z＝ABC＋BCD＋ACD＋ABD=6（3）根据逻辑表达式画出用“与非门”构成的逻辑电路如图5.2所示。图5.2表决电路逻辑图7（4）用实验验证逻辑功能在实验装置适当位置选定三个14P插座，按照集成块定位标记插好集成块74LS20。按图5.2接线，输入端A、B、C、D接至逻辑开关，输出端Z接逻辑电平，按真值表（自拟）要求，逐次改变输入变量，测量相应的输出值，验证逻辑功能，与表5－1进行比较，验证所设计的逻辑电路是否符合要求。实验提示：对与或非门而言，如果一个与门中的一条或几条输入引脚不被使用，则需将它们接高电平；如果一个与门不被使用,则需将此与门的至少一条输入引脚接低电平。8四、实验内容1.（选做）设计用与非门及用异或门、与门组成的半加器电路。要求按本文所述的设计步骤进行，直到测试电路逻辑功能符合设计要求为止。2.设计一个一位全加器，要求用异或门、与门、或门组成。3.设计一个一位全加器，要求用异或门、与门、或门组成。

4.设计一位全加器，要求用与或非门实现。

5.用双4选1数据选择器74LS153实现全加器。

1）写出设计过程2）画出接线图3）验证逻辑功能9五、实验预习要求及思考题1.根据实验任务要求设计组合电路，并根据所给的标准器件画出逻辑图。2.如何用最简单的方法验证“与或非”门的逻辑功能是否完好？

3.“与或非”门中，当某一组与端不用时，应作如何处理？

10六、实验报告1、列写实验任务的设计过程，画出设计的电路图。2、对所设计

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