Synopsys HAPS系列基于FPGA的ASIC原型最快捷的交付方式-1

SynopsysHAPS系列基于FPGA的ASIC原型最快捷的交付方式硅片tapeout前用于系统验证和硬件/软件集成的原型对于现在的IP和SoC设计团队而言必不可少。但是开发原型的时间很短，从RTL完备到获得芯片时间也很少，这意味着原型开发工程师必须尽快交付操作原型，他们所承受的压力巨大。HAPSProtoCompiler通过设计规划、逻辑综合、调试以及连接至其他验证环境（例如SynopsysVCS和ZeBu）等自动化功能，为IP验证和软件开发减少系统启动的时间和难度，只要该系统是基于SynopsysHAPS系列的。原型软件同HAPS系列紧密集成，以便实现传统“廉价”电路板和FPGA设计工具均无法企及的系统性能。功能：

HAPSProtoCompiler的功能用于加快实现原型的时间。这主要关注启动时间和计划的改善，从而使得处理时间最多可缩短至竞争产品的50%。HAPSProtoCompiler技术拥有高效的数据模型、编译器和分割工具，并通过使用基于FPGA原型的SynopsysHAPS系列，来提高工程师的工作效率。该系统可在设计流程的关键进程点中实现短迭代循环，而完成该部分向来很耗时。通过HAPS系列专用的快速编译器和时钟转换，来加速ASIC设计的编译和转换。2.5亿ASIC门分割引擎可自动生成适合多个FPGA的可行设计，仅需几分钟便能交付结果，相比之前的几小时更加便捷。重复使用对于ASIC设计和原型来说都是最佳实践。HAPS硬件架构的模块化性质结合HAPSProtoCompiler的增量和层次化项目管理功能，可避免冗长的重新编译及布局布线周期，从而加快启动时间。原型项目所开发的HAPS-DX及HAPS系列系统直接兼容，允许原型开发团队将单个ASIC模块或IP原型项目集成至较大型的子系统中，从而实现完整的SoC验证场景。功能

优势

针对HAPS的FPGA综合

DesignWare库兼容

HAPS系列事先验证ASICIP便于迁移

时序驱动的综合

最大化系统时钟速度

系统规划

系统硬件目标定位

管理HAPS子板、堆叠系统、互联和存储器

大容量设计分割

数百万ASIC门级设计，只需几分钟便可找到分割解决方案

硬件集成和重新使用

快速将原型模块组成较大型的子系统

调试和启动

支持多FPGA无缝调试

调试逻辑与设计模块的制定位置无关

SynopsysVerdi/Siloti数据交换

快速导入验证视图并进行根本原因分析

大容量调试样例储存

改善信号可视性并查看较长时间的系统运行

基于事务处理器的验证

AMBA事务处理器

结合基于FPGA以及虚拟原型，更快实现原型的可用性

比较

ProtoCompiler与ProtoCompilerDX的比较

了解更多ProtoCompiler与ProtoCompilerDX的不同，决定哪个更适合您的原型开发项目。

ProtoCompilerDX

ProtoCompiler

封装

包含在?HAPS-DX?中

与HAPS系统一起出售

系统支持

仅HAPS-DX

HAPS-DX/70/80

针对HAPS的FPGA逻辑综合

多处理

每个许可4个

DesignWare库支持

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硬件集成和重新使用

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Synopsys设计约束(SDC)兼容

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UnifiedPowerFormat(UPF)中推断存储器

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快速HDL编译模式

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高质量综合结果

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系统规划

系统硬件目标定位

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高速引脚复用

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多FPGA分割

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Virtex-7SuperLogicRegion(SLR)规划

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门控/生成的时钟转换

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UnifiedPowerFormat(UPF)支持

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调试和启动

无缝跨FPGA可视性

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HAPSDeepTraceDebug(DTD)SDRAM存储

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HAPSRealTimeDebug(RTD)逻辑分析器辅助

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调试RTL源代码

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针对HAPS的故障排除

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SynopsysVerdi/Siloti数据交换

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SynopsysFormality逻辑等效性检查(LEC)支持

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基于事务处理器的验证

AMBA事务处理器

单独出售

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SCE-MI事务处理器

单独出售

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系统要求HAPS系统先决条件HAPS-80系列HAPS-70系列HAPSDevelopereXpress(HAPS-DX)HAPS-80/70/DX系列混合系统OS支持

如需使用HAPSProtoCompiler高效设计功能（设计规划、逻辑综合和分割等）64位RedHatEnterpriseLinuxv5或更高版本64位SUSEEnterpriseLinuxv10或更高版本如需使用HAPSProtoCompiler实时调试功能（RTL调试、HAPS启动工具等）64位RedHatE